带有压缩的动态页映射
    1.
    发明公开

    公开(公告)号:CN119645295A

    公开(公告)日:2025-03-18

    申请号:CN202411297831.X

    申请日:2024-09-18

    Abstract: 各种应用能够包含具有带有压缩的动态页映射的存储器装置。所述存储器装置能够包含映射表,其具有条目位置以使虚拟页与所述虚拟页的数据的第一条带的物理地址相关联。所述条目位置能够包含旗标以及所述第一条带的所述物理地址。所述旗标能够将所述虚拟页的数据识别为经压缩或解压。响应于所述旗标识别虚拟页的所述数据经压缩,所述存储器装置的控制器经结构化以产生具有标头的所述第一条带的压缩数据的格式。所述标头能够包含存储所述虚拟页的压缩数据的额外物理地址的计数及所述额外物理地址。公开额外设备、系统及方法。

    主机控制的电子装置测试
    2.
    发明公开

    公开(公告)号:CN118749118A

    公开(公告)日:2024-10-08

    申请号:CN202380023593.0

    申请日:2023-03-14

    Abstract: 电子装置可以经配置以使主机能够间接控制与所述电子装置相关联的测试。所述主机与所述电子装置之间的接口可以是抽象的,使得所述主机不能直接控制所述电子装置。所述电子装置的实例包含存储器装置和功率管理集成电路。所述电子装置可以允许所述主机发现所述电子装置所支持的测试数量和相应测试描述符。所述电子装置可以与所述主机交互以配置测试和/或测试结果的报告。

    短时脉冲干扰检测
    3.
    发明公开

    公开(公告)号:CN118155703A

    公开(公告)日:2024-06-07

    申请号:CN202311495136.X

    申请日:2023-11-09

    Abstract: 本公开涉及短时脉冲干扰检测。一种方法可包含执行至少一个短时脉冲干扰抵抗操作及由包含于经由连接矩阵耦合到第一处理单元的短时脉冲干扰检测器中的电路检测存储器系统上的短时脉冲干扰的指示。所述方法可包含经由所述连接矩阵向至少一第二处理单元通知所述检测到的所述短时脉冲干扰的指示。所述方法可包含在通知至少所述第二处理单元之后,经由所述至少所述第二处理单元传输短时脉冲干扰确认信号。

    用于管理数据和错误信息的存储器控制器

    公开(公告)号:CN117940906A

    公开(公告)日:2024-04-26

    申请号:CN202280061985.1

    申请日:2022-09-06

    Abstract: 一种存储器控制器可包含:前端部分,其经配置以与主机介接;中央控制器部分,其经配置以管理数据;后端部分,其经配置以与存储器装置介接。所述存储器控制器可根据不同协议管理存储器装置。对于第一协议,所述存储器装置执行错误校正操作,且对于第二协议,所述存储器控制器执行错误校正操作。对于所述第一协议,经由数据引脚在所述存储器装置和所述存储器控制器之间交换错误校正信息、错误检测信息和/或元数据。对于所述第二协议,经由数据掩码反转引脚在所述存储器装置和所述存储器控制器之间交换错误校正信息、错误检测信息和/或元数据。所述第二协议可使根据所述第一协议启用的一些特征停用,例如低功率特征。

    用于非易失性存储器的总线加密
    5.
    发明公开

    公开(公告)号:CN113853588A

    公开(公告)日:2021-12-28

    申请号:CN201980096585.2

    申请日:2019-05-21

    Abstract: 本公开涉及用于存储器管理的设备和方法。本公开进一步涉及一种用于包含至少存储器阵列和耦合到所述存储器阵列的存储器控制器的快闪存储器装置的接口协议。主机装置通过通信信道耦合到所述存储器装置,且在所述通信信道中针对在所述主机装置与所述存储器阵列之间交换的数据、地址和命令采用硬件和/或软件完整加密‑解密方案。

    事务元数据
    7.
    发明公开

    公开(公告)号:CN111989659A

    公开(公告)日:2020-11-24

    申请号:CN201980026939.6

    申请日:2019-04-01

    Abstract: 与提供事务元数据相关的设备和方法。提供事务元数据包含使用耦接到存储器装置和控制器的地址总线提供存储于存储器装置中的数据的地址。提供事务元数据还包含使用耦接到存储器装置和控制器的数据总线传送来自存储器装置的与所述地址相关联的所述数据。提供事务元数据进一步包含使用耦接到存储器装置和控制器的事务元数据总线与所述数据总线同步并且结合所述地址总线传送边带信号。

    数据状态同步
    8.
    发明公开

    公开(公告)号:CN111033623A

    公开(公告)日:2020-04-17

    申请号:CN201880050599.6

    申请日:2018-07-24

    Abstract: 本发明包含用于数据状态同步的设备及方法。实例设备包含:执行写入操作以将数据模式存储于对应于具有第一状态的选定受管理单位的电阻可变存储器单元群组中;响应于执行所述写入操作而将所述选定受管理单位的状态从第一状态更新到第二状态;及在执行后续写入操作以将另一数据模式存储于所述电阻可变存储器单元群组中之前,通过将所述群组的所述全部可变电阻存储器单元置于相同状态而为对所述群组执行的后续写入操作提供数据状态同步。

    用于存储器装置的封装后修复资源

    公开(公告)号:CN119580807A

    公开(公告)日:2025-03-07

    申请号:CN202411234612.7

    申请日:2024-09-04

    Abstract: 本公开涉及用于存储器装置的封装后修复资源。各种应用可包含一种存储器装置,其实施与所述存储器装置的控制器集成的一或多个高速缓存或缓冲器以提供封装后修复资源。所述一或多个高速缓存或缓冲器可与存储所述存储器装置的用户数据的媒体子系统分离。所述一或多个高速缓存或缓冲器的布置可包含构造在所述存储器装置的解码器‑编码器布置与所述存储器装置的所述媒体子系统之间的所述一或多个高速缓存或缓冲器。所述一或多个高速缓存或缓冲器的其它布置可包含构造在所述一或多个高速缓存或缓冲器与所述存储器装置的所述媒体子系统之间的所述存储器装置的解码器‑编码器布置。可实施布置的组合。公开额外设备、系统及方法。

    RAS在具有压缩的CXL装置中触发L2P表移动

    公开(公告)号:CN119440891A

    公开(公告)日:2025-02-14

    申请号:CN202411049498.0

    申请日:2024-08-01

    Abstract: 本申请案涉及RAS在具有压缩的CXL装置中触发L2P表移动。在中央控制器系统中提供一种用于识别及缓解含有任务关键逻辑到物理寻址信息的裸片上的错误的系统及方法。所述逻辑到物理L2P寻址信息对于将未压缩数据的逻辑存储器地址转译为压缩数据的物理地址至关重要。当检测到含有L2P数据的裸片被破坏时,校正被破坏的数据,且将所有所述数据移动到相对于所述裸片的所述原始地址具有指定偏移的未被破坏的裸片。

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