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公开(公告)号：CN109660774A
公开(公告)日：2019-04-19
申请号：CN201811444510.2
申请日：2018-11-29
Applicant: 杭州电子科技大学
CPC classification number: H04N9/045 , G06T1/60 , G06T5/002 , G06T7/0004
Abstract: 本发明公开了基于FPGA的线阵错位图像复合去彩边方法，本发明设定2个移位寄存器，分别用来缓存颜色R行和G行的像素；设定3个RAM用来保存RGB的校正参数，对线阵相机拍摄到像素数据进行校正；设定一个位宽为3r的寄存器，将3个位宽为r位的单通道颜色值复合为1个3r位的数据；用去背景模块，对整个3r位的数据进行背景判别操作；设定一个移位寄存器用来保存去背景后的像素，通过一个T*T位宽的寄存器，对其进行去边缘操作；将结果保存在寄存器di中并输出。本发明能自行调节像素值的缓存行数，以达到最优的错位图像复合效果，并且可以进一步去除图像像素值错位造成的彩边和图像自身的噪点，以获得更加清晰符合实际的图像数据。
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公开(公告)号：CN109151459A
公开(公告)日：2019-01-04
申请号：CN201811053484.0
申请日：2018-09-11
Applicant: 杭州电子科技大学
IPC: H04N17/00
Abstract: 本发明公开了基于FPGA的线阵CCD波形校正方法及装置，其中装置包括FPGA、外部控制器、外部存储器、线阵CCD传感器，FPGA通过驱动所述线阵CCD传感器获取原始图像数据，将原始图像数据传输至外部控制器，从外部控制器或外部存储器接收校正系数，用于将原始数据与校正系数相乘得到校正结果并输出，所述FPGA包括线阵CCD驱动模块、原始图像数据缓存模块、数据传输模块、校正系数缓存模块和校正系数实时相乘模块。本发明通过外部控制计算出校正系数，并直接缓存在FPGA中，并在外部储存器中备份，简化再次校正时的步骤，实现了线阵CCD传感器的原始图像数据波形畸变的实时校正。
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公开(公告)号：CN109660774B
公开(公告)日：2020-12-01
申请号：CN201811444510.2
申请日：2018-11-29
Applicant: 杭州电子科技大学
Abstract: 本发明公开了基于FPGA的线阵错位图像复合去彩边方法，本发明设定2个移位寄存器，分别用来缓存颜色R行和G行的像素；设定3个RAM用来保存RGB的校正参数，对线阵相机拍摄到像素数据进行校正；设定一个位宽为3r的寄存器，将3个位宽为r位的单通道颜色值复合为1个3r位的数据；用去背景模块，对整个3r位的数据进行背景判别操作；设定一个移位寄存器用来保存去背景后的像素，通过一个T*T位宽的寄存器，对其进行去边缘操作；将结果保存在寄存器di中并输出。本发明能自行调节像素值的缓存行数，以达到最优的错位图像复合效果，并且可以进一步去除图像像素值错位造成的彩边和图像自身的噪点，以获得更加清晰符合实际的图像数据。
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公开(公告)号：CN109146953A
公开(公告)日：2019-01-04
申请号：CN201811053501.0
申请日：2018-09-11
Applicant: 杭州电子科技大学
CPC classification number: G06T7/62 , G06T7/0004 , G06T7/70 , G06T2207/30108
Abstract: 本发明公开了基于FPGA的标记面积块上限分离分道方法，包括以下步骤：设定起始像素和结束像素，使图像像素与滑槽宽度相对应；将起始像素、结束像素、设定的连通面积块下限值和上限值发送至FPGA；设定比较器组；设定k个寄存器，将上限通道值缓存k行后输出；根据连通域算法得到的面积块面积值来确定是否需要对这k个寄存器进行清零；在I+2N时钟之后，一行像素扫描完毕，当前行通道值压入寄存器队列，k行之前的通道寄存器发送给高速气阀控制板，满足喷气吹离要求的通道为1，否则为0。本发明精确有效地识别某个预设范围内的面积块并且做出相应操作，极大地降低了误识别或误操作的概率。
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Patent Agency Ranking
公开(公告)号：CN109087314A
公开(公告)日：2018-12-25
申请号：CN201810936977.2
申请日：2018-08-16
Applicant: 杭州电子科技大学
Abstract: 本发明公开了基于FPGA的线阵图像连通域面积快速标记统计方法，包括以下步骤：对当前像素、上边像素和左边像素进行保存和读取；对连通面积块进行标记和面积计算。本发明应用在对图像处理速度要求很高的设备中，标记同一面积块的连通区域，可以实现面积块的区分，面积块面积的计算。并且，这种方法处理的像素是线阵相机采集的行像素，不需要保存大量的图像数据，而只需要保存两行像素，并保持像素不断更新，即可完成对图像连通域的快速标记和处理。
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公开(公告)号：CN109102540B
公开(公告)日：2022-01-28
申请号：CN201810936890.5
申请日：2018-08-16
Applicant: 杭州电子科技大学
Abstract: 本发明公开了基于FPGA的标记面积块下限分离分道方法，包括以下步骤：设定起始像素和结束像素，使其与滑槽的宽度相对应；将中间变量、起始像素、结束像素和设定的连通面积块下限值发送至FPGA；设定通道标号寄存器进行保存；设定比较器的输入为cal_temp和0，如果相等，则当前像素在第1个通道，对下限通道寄存器进行清零；设定比较器的输入为当前像素和0，如果大于0则将当前像素对应的连通面积块标记值保存；设定比较器组，和设定K个比较器；在I+2N时钟之后，一行像素扫描完毕，将下限通道寄存器的值发送给高速气阀控制板，满足喷气吹离要求通道置1，不满足置0。本发明精确有效地识别面积块并且做出相应操作，极大地降低了误识别或误操作的概率。
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公开(公告)号：CN109146953B
公开(公告)日：2021-12-10
申请号：CN201811053501.0
申请日：2018-09-11
Applicant: 杭州电子科技大学
Abstract: 本发明公开了基于FPGA的标记面积块上限分离分道方法，包括以下步骤：设定起始像素和结束像素，使图像像素与滑槽宽度相对应；将起始像素、结束像素、设定的连通面积块下限值和上限值发送至FPGA；设定比较器组；设定k个寄存器，将上限通道值缓存k行后输出；根据连通域算法得到的面积块面积值来确定是否需要对这k个寄存器进行清零；在I+2N时钟之后，一行像素扫描完毕，当前行通道值压入寄存器队列，k行之前的通道寄存器发送给高速气阀控制板，满足喷气吹离要求的通道为1，否则为0。本发明精确有效地识别某个预设范围内的面积块并且做出相应操作，极大地降低了误识别或误操作的概率。
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公开(公告)号：CN109087314B
公开(公告)日：2021-08-31
申请号：CN201810936977.2
申请日：2018-08-16
Applicant: 杭州电子科技大学
Abstract: 本发明公开了基于FPGA的线阵图像连通域面积快速标记统计方法，包括以下步骤：对当前像素、上边像素和左边像素进行保存和读取；对连通面积块进行标记和面积计算。本发明应用在对图像处理速度要求很高的设备中，标记同一面积块的连通区域，可以实现面积块的区分，面积块面积的计算。并且，这种方法处理的像素是线阵相机采集的行像素，不需要保存大量的图像数据，而只需要保存两行像素，并保持像素不断更新，即可完成对图像连通域的快速标记和处理。
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公开(公告)号：CN109102540A
公开(公告)日：2018-12-28
申请号：CN201810936890.5
申请日：2018-08-16
Applicant: 杭州电子科技大学
Abstract: 本发明公开了基于FPGA的标记面积块下限分离分道方法，包括以下步骤：设定起始像素和结束像素，使其与滑槽的宽度相对应；将中间变量、起始像素、结束像素和设定的连通面积块下限值发送至FPGA；设定通道标号寄存器进行保存；设定比较器的输入为cal_temp和0，如果相等，则当前像素在第1个通道，对下限通道寄存器进行清零；设定比较器的输入为当前像素和0，如果大于0则将当前像素对应的连通面积块标记值保存；设定比较器组，和设定K个比较器；在I+2N时钟之后，一行像素扫描完毕，将下限通道寄存器的值发送给高速气阀控制板，满足喷气吹离要求通道置1，不满足置0。本发明精确有效地识别面积块并且做出相应操作，极大地降低了误识别或误操作的概率。
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