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公开(公告)号：CN114556378A
公开(公告)日：2022-05-27
申请号：CN202080072654.9
申请日：2020-10-18
Applicant: 微软技术许可有限责任公司
IPC: G06N10/00
Abstract: 提供了一种量子计算设备，其包括逻辑量子位编码表面，该逻辑量子位编码表面包括多个元格。多个元格中的每个元格可以包括多个基于测量的量子位。多个基于测量的量子位可以包括四个数据量子位和第一辅助量子位。第一辅助量子位可以被电连接到四个数据量子位和被包括在逻辑量子位编码表面中的第二辅助量子位。
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公开(公告)号：CN114223005A
公开(公告)日：2022-03-22
申请号：CN202080055436.4
申请日：2020-06-09
Applicant: 微软技术许可有限责任公司
Abstract: 一种量子计算设备，该量子计算设备包括至少一个量子寄存器，该至少一个量子寄存器包括多个逻辑量子比特。压缩引擎被耦合到多个逻辑量子比特中的每个逻辑量子比特。每个压缩引擎被配置为压缩伴随数据。解压缩引擎被耦合到每个压缩引擎。每个解压缩引擎被配置为接收经压缩的伴随数据，解压缩接收到的经压缩的伴随数据，并且将经解压缩的伴随数据路由到解码器块。
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公开(公告)号：CN120069102A
公开(公告)日：2025-05-30
申请号：CN202510151544.6
申请日：2020-06-09
Applicant: 微软技术许可有限责任公司
Abstract: 一种量子计算设备，该量子计算设备包括至少一个量子寄存器，该至少一个量子寄存器包括多个逻辑量子比特。压缩引擎被耦合到多个逻辑量子比特中的每个逻辑量子比特。每个压缩引擎被配置为压缩伴随数据。解压缩引擎被耦合到每个压缩引擎。每个解压缩引擎被配置为接收经压缩的伴随数据，解压缩接收到的经压缩的伴随数据，并且将经解压缩的伴随数据路由到解码器块。
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Patent Agency Ranking
公开(公告)号：CN114207633B
公开(公告)日：2025-03-21
申请号：CN202080055659.0
申请日：2020-06-09
Applicant: 微软技术许可有限责任公司
Abstract: 一种量子计算设备，该量子计算设备包括至少一个量子寄存器，该至少一个量子寄存器包括l个逻辑量子比特，其中l是正整数。该量子计算设备还包括d个解码器块的集合，该d个解码器块的集合耦合到至少一个量子寄存器，其中d
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公开(公告)号：CN114223005B
公开(公告)日：2025-02-25
申请号：CN202080055436.4
申请日：2020-06-09
Applicant: 微软技术许可有限责任公司
Abstract: 一种量子计算设备，该量子计算设备包括至少一个量子寄存器，该至少一个量子寄存器包括多个逻辑量子比特。压缩引擎被耦合到多个逻辑量子比特中的每个逻辑量子比特。每个压缩引擎被配置为压缩伴随数据。解压缩引擎被耦合到每个压缩引擎。每个解压缩引擎被配置为接收经压缩的伴随数据，解压缩接收到的经压缩的伴随数据，并且将经解压缩的伴随数据路由到解码器块。
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公开(公告)号：CN114830142A
公开(公告)日：2022-07-29
申请号：CN202080087193.2
申请日：2020-11-04
Applicant: 微软技术许可有限责任公司
Inventor： N·G·德尔福瑟
IPC: G06N10/00
Abstract: 量子计算系统包括解码单元，该解码单元实现与更复杂的解码器顺序连接的低成本“隔离故障解码器”，以便显著降低带宽消耗并且降低用于执行实现目标错误纠正率的错误纠正所需的解码硬件数量。隔离故障解码器从量子计算系统的测量电路接收校验子并且实现逻辑以尝试标识解释校验子并且还满足限制集合中的每对故障之间的接近度的故障隔离阈值的故障集。
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公开(公告)号：CN114207633A
公开(公告)日：2022-03-18
申请号：CN202080055659.0
申请日：2020-06-09
Applicant: 微软技术许可有限责任公司
Abstract: 一种量子计算设备，该量子计算设备包括至少一个量子寄存器，该至少一个量子寄存器包括l个逻辑量子比特，其中l是正整数。该量子计算设备还包括d个解码器块的集合，该d个解码器块的集合耦合到至少一个量子寄存器，其中d
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公开(公告)号：CN114207632A
公开(公告)日：2022-03-18
申请号：CN202080055614.3
申请日：2020-06-09
Applicant: 微软技术许可有限责任公司
Abstract: 一种量子计算设备，包括：至少一个量子寄存器，包括多个量子比特；以及硬件解码器。该硬件解码器被配置为：从多个量子比特中的一个或多个量子比特接收伴随数据；以及通过经由包括两个或更多个流水线级的硬件微架构实现并查解码算法，对接收到的伴随数据进行解码。
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