调制电路
    2.
    发明授权

    公开(公告)号:CN113783574B

    公开(公告)日:2024-03-26

    申请号:CN202111166457.6

    申请日:2021-09-30

    Abstract: 本申请涉及一种调制电路。调制电路包括数据选择器、多级调制电路、时钟生成电路和电源电路。所述数据选择器包括数据选择器输出端和多个数据选择器输入端。所述多个数据选择器输入端用于与外部传感信号连接。所述多级调制电路的输入端与所述数据选择器输出端电连接。所述时钟生成电路输出端与所述多级调制电路的时钟信号输入端电连接。所述时钟生成电路用于向所述多级调制电路输出互不交叠时钟信号,以使所述多级调制电路的输出端输出调制信号。所述电源电路与所述多级调制电路的电源输入端电连接。本实施例提供的调制电路精度高,可以比较精确地检测出智能电网中信号的细微波动,能很好地满足智能电网的监测要求。

    电力纳米继电器安全运行方法及装置

    公开(公告)号:CN116319080B

    公开(公告)日:2023-09-15

    申请号:CN202310548243.8

    申请日:2023-05-16

    Abstract: 本申请涉及一种电力纳米继电器安全运行方法、装置、设备和介质。所述方法包括:获取主纳米继电器阵列的受攻击信息;根据受攻击信息得到第一加密数据;根据受攻击信息启动备用纳米继电器阵列;将第一加密数据传输至备用纳米继电器阵列;根据第一加密数据得到第一解密数据;根据第一解密数据控制备用纳米继电器阵列运行。通过主纳米继电器阵列受到网络攻击时发出的受攻击信息,将主纳米继电器阵列的当前数据通过加密后发送至备用纳米继电器阵列,使备用纳米继电器阵列可以根据解密后的数据继续控制电力系统,从而保证了电力系统在受到攻击的情况下,可以正常、稳定、可靠的运行,不仅运行方法更加安全有效,而且运行效率也较高。

    电力专用芯片的资源分配方法、装置和计算机设备

    公开(公告)号:CN116483561A

    公开(公告)日:2023-07-25

    申请号:CN202310417691.4

    申请日:2023-04-18

    Abstract: 本申请涉及一种电力专用芯片的资源分配方法、装置、计算机设备、存储介质和计算机程序产品。所述方法包括:接收资源控制端发送的资源监控指示信息;按照所述资源监控指示信息,监控各电力专用芯片在监控时间范围内执行数据业务的过程中产生的算力消耗信息和数据流量信息;根据所述算力消耗信息和所述数据流量信息,确定各所述电力专用芯片的内存资源占用率;上报各所述电力专用芯片的内存资源占用率至所述资源控制端;所述资源控制端用于按照各所述电力专用芯片的内存资源占用率对各所述电力专用芯片进行内存资源分配。采用本方法能够提高对电力专用芯片的内存资源分配效率。

    电力专用时钟分路复用电路

    公开(公告)号:CN115065436B

    公开(公告)日:2022-11-25

    申请号:CN202210984014.6

    申请日:2022-08-16

    Abstract: 本申请涉及一种电力专用时钟分路复用电路,包括:时钟发生电路、时钟缓冲电路、电网芯片、至少一个端口物理层PHY芯片;电网芯片上集成有至少两个介质访问控制器MAC;时钟发生电路与时钟缓冲电路连接,时钟缓冲电路的第一输出端与电网芯片的第一时钟引脚连接,第一时钟引脚分别与各MAC连接,时钟缓冲电路的第二输出端分别与各PHY芯片的第二时钟引脚连接;时钟发生电路生成时钟信号;时钟缓冲电路生成第一同源时钟信号和第二同源时钟信号,并将第一同源时钟信号传输至电网芯片的第一时钟引脚,将第二同源时钟信号分别传输至各PHY芯片的第二时钟引脚。该电力专用时钟分路复用电路减少了以太网接口电路的引脚布线的数量。

    片上系统芯片架构
    10.
    发明公开

    公开(公告)号:CN113836081A

    公开(公告)日:2021-12-24

    申请号:CN202111154849.0

    申请日:2021-09-29

    Abstract: 本申请所提供了一种片上系统芯片架构。所述片上系统芯片架构包括基于精简指令集原则的开源指令集架构、存储器、AHB总线矩阵、总线架构和外设模块。所述基于精简指令集原则的开源指令集架构与所述存储器电连接。AHB总线矩阵与所述存储器和所述基于精简指令集原则的开源指令集架构电连接。所述基于精简指令集原则的开源指令集架构通过所述总线架构与所述存储器和所述AHB总线矩阵电连接。所述AHB总线矩阵与所述外设模块电连接。通过基于精简指令集原则的开源指令集架构,可以自主可控的进行开发。所述基于精简指令集原则的开源指令集架构通过所述总线架构与所述存储器和所述AHB总线矩阵电连接,所述AHB总线矩阵与所述外设模块电连接,可以对缓存、总线、核心的性能和参数等进行自主可控的配制设计,能够针对不同的应用场景完成自主可控的开发。

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