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公开(公告)号：CN212875758U
公开(公告)日：2021-04-02
申请号：CN202021365711.6
申请日：2020-07-13
Applicant: 上海复旦微电子集团股份有限公司
Abstract: 本实用新型公开了一种低相噪多路时钟发生电路，包括：控制信号模块，输入端与控制电路连接；时钟通路选择模块，第一输入端与多路时钟模块输出端连接，第二输入端与控制信号模块第一输出端连接，第一输出端与多路时钟模块输入端连接；时钟发生模块，第一输入端与控制信号模块第二输出端连接，第二输入端与时钟通路选择模块的第二输出端连接，输出端与时钟通路选择模块的第三输入端连接。此实用新型解决了传统低相躁时钟模块的测试环境无法提供直流参数测试通路，无法测试时钟信号管脚的DC电特性的问题，通过提供多路低相噪的时钟，并给ATE测试环境提供了具备测试管脚DC电特性的功能，极大提升了高精度时钟的供给能力，增加了待测器件的测试覆盖率。
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