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发明公开
多位累加器和具有多位累加器的存储器内计算处理器审中-公开

公开(公告)号：CN119731636A

公开(公告)日：2025-03-28

申请号：CN202380059552.7

申请日：2023-09-14

Applicant: 三星电子株式会社

Inventor： 明成民 , 昌东真 , 李宰赫 , 尹大健 , 尹石柱

IPC: G06F7/544 , G06F7/53 , G06F7/62 , G06F15/78 , G06N3/063

Abstract: 一种多位累加器包括：多个1位华莱士树，各自被配置为对单个位输入数据执行加法运算；多个三态逻辑电路，各自被配置为根据提供给所述多个三态逻辑电路的启用信号而输出所述多个1位华莱士树的加法运算的结果；以及移位加法器，被配置为基于时钟信号通过移位操作对所述多个1位华莱士树的加法运算的结果执行累加运算。

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