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公开(公告)号：CN107656895B
公开(公告)日：2023-07-28
申请号：CN201711019841.7
申请日：2017-10-27
申请人： 上海力诺通信科技有限公司
发明人： 谭德海
IPC分类号： G06F15/16
摘要： 本发明公开了一种1U标准高度的正交平台高密度计算架构，由主板设计和电源构成，主板设计在1U标准高度的正交节点槽位采用四星处理架构的E5‑V4计算架构，两边采用标准的服务器主板，每个服务器主板各自带有两个CPU，通过高密度的网络融合卡，将两个分离的主板融合到正交架构的1U高度的节点槽位，四星处理架构的E5‑V4计算架构，可以选择多达14核的CPU，每个CPU都有两个40GE网络连接到不同的正交交换卡，与交换卡之间拥有40GE的大流量的数据通路，又可以通过两个40GE的网络连接实现冗余切换，满足整个系统架构核数更多、网络流量更大、软硬件优化一体化的需求。
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公开(公告)号：CN113722263B
公开(公告)日：2023-07-14
申请号：CN202111036152.3
申请日：2021-09-06
申请人： 浪潮通用软件有限公司
发明人： 韩保铎
IPC分类号： G06F15/16
摘要： 本发明提出了一种集群数据采集方法，方法包括在所述集群的子节点中进行的以下步骤：在集群的子节点中预设主节点的IP地址、接口信息以及数据采集配置文件；响应于子节点启动，基于数据采集配置文件生成数据采集接口，并通过主节点的IP地址及接口信息向主节点发起接口注册请求；响应于注册成功，向主节点开放所述数据采集接口。本发明的有益效果包括：本发明通过在子节点中预设数据采集配置文件，并在子节点启动后，基于数据采集配置文件生成数据采集接口，并向主节点发起接口注册请求的方式实现了在服务应用部署前，提前在各个子节点中部署数据采集接口，从而为后续数据采集的快速二次开发供了基础。
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公开(公告)号：CN110096472B
公开(公告)日：2023-06-30
申请号：CN201910073036.5
申请日：2019-01-25
申请人： 慧与发展有限责任合伙企业
摘要： 本发明涉及节点集群中管理节点的选择。示例实施方式涉及节点集群。在示例中，方法包括计算包括多个节点的分布式存储系统中的第一节点的分数。分数是以下中的至少一个的函数：第一节点的位置、第一节点的健康状况和第一节点的资源利用率。然后，基于该分数以及与多个节点相关联的多个分数来确定多个节点中的第一节点的排名。当第一节点的排名至少等于预定义排名时，向第一节点发送指令以实例化用于对第一节点上的分布式存储系统进行管理的管理过程。
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公开(公告)号：CN116303210A
公开(公告)日：2023-06-23
申请号：CN202211593983.5
申请日：2022-12-13
申请人： 英特尔公司
发明人： 斯坦利·陈 , 维韦克·加尔格 , 安库什·瓦尔玛 , 埃里克·J·德海默 , 约翰·范·德·格罗嫩达尔
摘要： 本申请提供了用于计算机处理器的寄存器接口。在一实施例中，一种处理器可包括：至少一个处理引擎，用于执行指令；以及与该至少一个处理引擎耦合的寄存器接口电路。该寄存器接口电路可以：接收访问与处理器的特征相关联的寄存器的请求；至少部分地基于访问结构的条目来确定所请求的访问是否被授权，该访问结构存储了与处理器的多个特征相关联的多个条目；并且响应于确定所请求的访问被访问结构授权，执行对与特征相关联的寄存器的所请求的访问。描述并要求保护了其他实施例。
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公开(公告)号：CN111736986B
公开(公告)日：2023-06-23
申请号：CN202010471493.2
申请日：2020-05-29
申请人： 浪潮(北京)电子信息产业有限公司
IPC分类号： G06F9/50 , G06F15/16 , G06N3/0464 , G06N3/063
摘要： 本申请公开了一种深度学习模型的FPGA加速执行方法，包括：FPGA云服务器根据模型计算量和FPGA板卡计算量对待执行的深度学习模型进行拆分处理，得到深度学习模型中所有卷积核的拆分配置数据；根据拆分配置数据将深度学习模型中的卷积核部署至对应的FPGA板卡，得到多个待执行FPGA板卡；控制多个待执行FPGA板卡执行深度学习模型计算操作。通过将深度学习模型中的所有卷积核拆分至对应的FPGA板卡中进行计算操作，实现将模型拆分计算，而不是在少数几个FPGA板卡中加载过多的计算功能，避免产生硬件浪费，提高硬件性能的利用率。本申请还公开了一种深度学习模型的FPGA加速执行装置、服务器以及计算机可读存储介质，具有以上有益效果。
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公开(公告)号：CN112491693B
公开(公告)日：2023-06-20
申请号：CN202011284625.7
申请日：2015-04-30
申请人： 苹果公司
IPC分类号： H04L51/08 , H04L51/046 , H04L51/42 , G06F15/16 , G06Q10/107
摘要： 本发明涉及发送大电子邮件附件的双服务器系统。本发明公开了一种具有触敏表面和显示器的电子设备，该电子设备可执行即时消息应用程序。即时消息应用程序提供用于发送具有大附件的消息的选项。在一个选项中，其允许通过将大附件上载并存储到云服务器上来发送具有大附件的消息，将对存储位置的链接嵌入消息中，并且将该消息发送而不具有附件。即时消息应用程序还可在消息中包括UI元素，该UI元素包括有关存储的附件的状态的指示符。此外，即时消息应用程序可在发送消息之前将附件的较小尺寸的版本嵌入该消息中。该状态指示符可显示对存储位置的链接是否截止或者先前是否已从云服务器检索该附件。
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公开(公告)号：CN111651208B
公开(公告)日：2023-06-20
申请号：CN202010382704.5
申请日：2020-05-08
申请人： 上海交通大学
摘要： 本发明提供了一种面向异构众核并行计算机的模态并行计算方法及系统，包括如下步骤：步骤S1：通过有限元程序生成有限元模型刚度矩阵、质量矩阵数据，将生成的有限元模型刚度矩阵、质量矩阵数据剖分为N个子区域，并将每个区域的有限元模型刚度矩阵和质量矩阵数据单独保存于一个文件中，其中N为单个核组的整数倍；步骤S2：令进行并行计算的各核组主核同步读取各子区域对应的有限元模型刚度矩阵和质量矩阵数据，各核组间无数据通信交流，核组内各从核间无数据通信交流。本发明通过分层策略实现了计算过程和数据通信的分层，将大量数据通信限定在各核组内部，充分发挥国产异构众核并行计算机核组内通信速率较高的优势。
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公开(公告)号：CN116257467A
公开(公告)日：2023-06-13
申请号：CN202211725803.4
申请日：2022-12-30
IPC分类号： G06F12/084 , G06F12/0842 , G06F15/78 , G06F15/16 , G06F9/445
摘要： 本发明公开了一种MCM‑GPU自适应末级高速缓存结构，设置于GPU模块中，包括：Tag Array和Date Array，Data Array用于储存数据，Tag Array用于查看地址对应的数据是否在缓存中，还包括：本地访存队列，用于存储当前GPU模块的访存请求；远端访存队列，用于存储其他GPU模块的访存请求；LLC架构改变标记位寄存器，用于存储指示当前的末级高速缓存的架构组织方式是否需要改变的LLC架构改变标记位；LLC架构标记位寄存器，用于存储指示将当前的末级高速缓存切换为私有末级高速缓存设计或共享末级高速缓存设计的LLC架构标记位。本发明能够支持共享末级高速缓存和私有末级高速缓存的动态切换，能够根据程序运行时的配置自适应地选择末级高速缓存架构组织方式，满足程序访存需求，提高MCM‑GPU的性能。
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公开(公告)号：CN116226022A
公开(公告)日：2023-06-06
申请号：CN202211736901.8
申请日：2022-12-30
申请人： 西安易朴通讯技术有限公司
IPC分类号： G06F15/16 , G06F15/163 , G06F13/40
摘要： 本发明提供一种多节点刀片服务器及其管理办法，该多节点刀片服务器包括：机箱管理控制器CMC、多个节点；节点包括：桥接芯片BIC和中央处理器CPU；BIC结合CMC实现对相应节点的基板管理；CMC还用于实现系统健康监控管理；CPU用于通过BIC与CMC进行通信；也即，本申请采用低成本BIC来替代传统BMC，进而降低多节点刀片服务器的成本，所降低的成本与多节点刀片服务器中节点数成正比，进而，当多节点刀片服务器中的节点数较大时，多节点刀片服务器所节约的成本非常可观；同时，用BIC来替代传统BMC，能够减小多节点刀片服务器的体积。
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公开(公告)号：CN116209989A
公开(公告)日：2023-06-02
申请号：CN202180063700.3
申请日：2021-09-16
申请人： 塞申斯技术公司
发明人： 拉杜·内古列斯库 , 拉杜·亚历山德鲁·廷特斯库 , 劳伦蒂乌·彼得鲁特·乔巴努
IPC分类号： G06F15/16
摘要： 提供了用于执行交互模型和控制情境驱动的用户交互的计算机实现的系统和方法。每个生成的交互模型可以包括标识在建模的交互的会话中可执行的一个或更多个交互对象和一个或更多个模块的数据。本公开的实施例还提供了用于处理和管理在这些交互中交换的数据的技术解决方案。可以提供数据构建，该数据构建使得能够进行有效的知识保留并标识数据是如何在用户之间共享、收集和/或开发的。
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