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公开(公告)号：CN112367310B
公开(公告)日：2022-11-18
申请号：CN202011167693.5
申请日：2020-10-28
Applicant: 北京计算机技术及应用研究所
IPC: H04L9/40 , H04L69/22 , H04L69/06 , G05B19/042
Abstract: 本发明涉及一种基于FPGA的SRIO总线加密传输装置，属于数据传输技术领域。本发明提出的一种基于FPGA的SRIO总线加密传输装置，该装置基于FPGA可编程逻辑设计实现，同时结合SRIO协议的特点，仅要求用户传输的有效数据载荷为256字节的整数倍，并内置加解密模块实现了高速数据的加密传输，并通过门铃包实现数据帧的同步。该装置能够满足用户数据在现有SRIO网络里的加密传输需求，极大提升了数据传输的安全性，从而满足特定领域的应用需求。
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公开(公告)号：CN110069442B
公开(公告)日：2022-10-14
申请号：CN201910333400.7
申请日：2019-04-24
Applicant: 北京计算机技术及应用研究所
Abstract: 本发明涉及一种基于ZYNQ系列FPGA的超高速数据采集装置及方法，涉及数据采集技术领域。本发明的装置基于RAID阵列控制实现NVMe固态盘阵列的自动化读写访问控制；基于多通道DDR3/DDR4控制器虚拟FIFO技术，极大提升了内存的访问带宽；通过全交换矩阵实现了采集和回放流程中的数据通路选择。该装置具有10GB/s以上的超高性能，可广泛应用于高清视频、雷达数据和AD采集等高性能应用场景。
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公开(公告)号：CN114915604A
公开(公告)日：2022-08-16
申请号：CN202210561007.5
申请日：2022-05-23
Applicant: 北京计算机技术及应用研究所
Inventor： 侯运通 , 张红磊 , 龚清生 , 聂煜桐 , 邓硕 , 沈月峰 , 王吕大 , 杨帆 , 孙大东 , 陕振 , 徐海旭 , 濮约刚 , 张明庆 , 贾振华 , 赵明亮 , 王艳 , 李正坤
IPC: H04L49/90 , H04L49/901
Abstract: 本发明涉及一种基于FPGA的降低网络链路层拥塞的系统与方法，属于流量控制技术领域。本发明的系统中，所设计的DDR3SRAM的外部缓存大大减少了终端的MAC控制器收到暂停帧的次数，减少了网络的拥塞行为，使终端中的MAC控制器发送行为更加流畅。
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公开(公告)号：CN110825674A
公开(公告)日：2020-02-21
申请号：CN201911041998.9
申请日：2019-10-30
Applicant: 北京计算机技术及应用研究所
IPC: G06F13/32
Abstract: 本发明涉及一种基于FPGA的PCIE DMA交互系统及交互方法，属于DMA技术领域。本发明采用一种新的方案，对现有CPU轮询寄存器(R2)的方式作了改进，实现了FPGA板卡与CPU之间的PCIE多通道DMA交互，有效降低了对CPU资源和PCIE带宽的占用，提高了PCIE传输效率。
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公开(公告)号：CN119782225A
公开(公告)日：2025-04-08
申请号：CN202411808233.4
申请日：2024-12-10
Applicant: 北京计算机技术及应用研究所
IPC: G06F13/38 , H04L41/0895 , G06F13/42 , G06F15/78
Abstract: 本发明涉及一种基于USB批量传输的组合通信设备及数据分流方法，属于网络通信技术领域。本发明基于USB批量传输协议配置组合设备描述符，并在单片机内对各功能设备数据进行分流处理，使该USB组合设备同时具备网络通信能力和USB数据读写能力，满足在同一设备上对以上两种功能同时使用的需求。
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Patent Agency Ranking
公开(公告)号：CN115454901A
公开(公告)日：2022-12-09
申请号：CN202211033710.5
申请日：2022-08-26
Applicant: 北京计算机技术及应用研究所
Abstract: 本发明涉及一种基于FPGA的LVDS高速通信系统及方法，属于LVDS通信技术领域。本发明通过对LVDS电路和对应的FPGA程序模块的设计，实现了FPGA芯片之间的高速通信，并且实现了数据包流控以及错误重传功能，从而实现了可靠传输。
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公开(公告)号：CN110825674B
公开(公告)日：2021-02-12
申请号：CN201911041998.9
申请日：2019-10-30
Applicant: 北京计算机技术及应用研究所
IPC: G06F13/32
Abstract: 本发明涉及一种基于FPGA的PCIE DMA交互系统及交互方法，属于DMA技术领域。本发明采用一种新的方案，对现有CPU轮询寄存器(R2)的方式作了改进，实现了FPGA板卡与CPU之间的PCIE多通道DMA交互，有效降低了对CPU资源和PCIE带宽的占用，提高了PCIE传输效率。
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公开(公告)号：CN118427827A
公开(公告)日：2024-08-02
申请号：CN202410245544.8
申请日：2024-03-05
Applicant: 北京计算机技术及应用研究所
Abstract: 本发明涉及一种可信度量安全增强电路，属于可信计算技术领域。本发明的增强电路包括：CPLD逻辑电路、TCM可信模块、硬件与门、CPU处理器。CPLD逻辑电路控制CPU的上电，TCM可信模块获取固件的度量值并进行开机的主动度量，硬件与门的输入信号为CPLD释放的复位信号和TCM度量信号，当两者都为高电平时，输出为高电平。本发明的方法避免了原来单一控制因素使信任链不安全，即只需CPLD释放CPU冷复位信号即可使CPU正常工作，从而造成如果人为更改CPLD使其不经TCM通知即释放CPU冷复位造成的主动度量过程被旁路。
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公开(公告)号：CN118426956A
公开(公告)日：2024-08-02
申请号：CN202410525330.6
申请日：2024-04-29
Applicant: 北京计算机技术及应用研究所
Inventor： 李正坤 , 李校南 , 王艳 , 邓硕 , 王震 , 祁春慧 , 赵明亮 , 沈月峰 , 王吕大 , 王慧咏 , 范京凯 , 高小淼 , 王军 , 龚志力 , 马煜杰 , 孙大东 , 陕振
IPC: G06F9/50
Abstract: 本发明涉及一种针对多CPU异构的主动度量加速方法，属于计算平台技术领域。本发明通过对计算(机)平台硬件电路的改进，实现了使用FPGA内置杂凑算法引擎同时对多个CPU的BIOS进行主动度量，并利用单个可信模块进行预期值比对，在保证信任链的完整性的情况下，既减少了设计成本，同时又有效缩减了主动度量时间，提升了使用体验。
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公开(公告)号：CN110163011B
公开(公告)日：2021-06-08
申请号：CN201910397568.4
申请日：2019-05-14
Applicant: 北京计算机技术及应用研究所
IPC: G06F21/80
Abstract: 本发明涉及一种高速安全硬盘设计方法，涉及计算机存储技术领域。本发明采用延迟更低、速度更高的NVMe接口与主机连接，安全加密防护单元设置多个加密算法核对数据进行加解密，并设置多个硬盘并行存取数据，数据吞吐率可达千兆字节每秒数量级，大大提高了安全硬盘的性能。
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