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    管理存储器阵列的方法和装置
    91.
    发明授权
    管理存储器阵列的方法和装置 有权

    公开(公告)号：CN103577274B

    公开(公告)日：2016-07-06

    申请号：CN201210270002.3

    申请日：2012-07-31

    申请人： 国际商业机器公司

    发明人： 李明强 ,  何欢

    IPC分类号： G06F11/08

    CPC分类号： G06F11/1076 ,  H03M13/1102 ,  H03M13/1515 ,  H03M13/27 ,  H03M13/293 ,  H03M13/2942 ,  H03M13/373

    摘要： 本发明提供管理存储器阵列的方法和装置。所述方法包括，将存储器阵列条带化以形成多个条带；从每个条带中选择F个存储块作为本地校验块，并从存储器阵列中另外选择L个存储块作为全局校验块；对条带中的所有数据块进行（F+L）容错纠删编码，以生成（F+L）组校验数据，将其中的F组校验数据存储在所述F个本地校验块中；对于另外L组校验数据，进行跨条带运算以生成L组全局校验数据，将其分别存储在所述L个全局校验块中。所述装置与方法对应。通过本发明实施例的方法和装置，能够对存储器阵列中的多种错误进行检测和/或恢复，提高存储器阵列的容错能力和空间利用率。

    数据处理装置和数据处理方法
    93.
    发明公开
    数据处理装置和数据处理方法 无效

    公开(公告)号：CN105531937A

    公开(公告)日：2016-04-27

    申请号：CN201480050435.5

    申请日：2014-09-05

    申请人： 索尼公司

    发明人： 篠原雄二 ,  山本真纪子

    IPC分类号： H03M13/19

    CPC分类号： H03M13/1102 ,  H03M13/036 ,  H03M13/1165 ,  H03M13/152 ,  H03M13/255 ,  H03M13/271 ,  H03M13/2906 ,  H03M13/616 ,  H04L1/1887

    摘要： 本技术涉及数据处理装置以及数据处理方法，其能够提供具有良好的误码率的LDPC码。LDPC编码器使用具有64800位的码长以及5/15的编码率的LDPC码编码。所述LDPC码包含信息位和奇偶位，并且用于所述LDPC码的奇偶校验矩阵(H)包括与所述LDPC码的信息位相对应的信息矩阵部以及与所述奇偶位相对应的奇偶矩阵部。奇偶校验矩阵(H)的信息矩阵部由奇偶校验矩阵初始值表表示，该奇偶校验矩阵初始值表表示每360列的所述信息矩阵部的1元素的位置。在执行LDPC编码和LDPC解码时可以应用本技术。

    具有通过单播系统传送的递增冗余的广播系统
    98.
    发明授权
    具有通过单播系统传送的递增冗余的广播系统 有权

    公开(公告)号：CN102668384B

    公开(公告)日：2015-10-07

    申请号：CN201080059117.7

    申请日：2010-11-30

    申请人： 索尼公司

    发明人： 纳比尔·罗金 ,  罗萨尔·斯塔德梅尔 ,  乔格·罗伯特

    IPC分类号： H03M13/25 ,  H04L1/18

    CPC分类号： H03M13/253 ,  H03M13/1102 ,  H03M13/152 ,  H03M13/255 ,  H03M13/6306 ,  H03M13/6393 ,  H03M13/6552 ,  H04L1/02 ,  H04L1/1819 ,  H04L1/1893 ,  H04L2001/0093

    摘要： 本发明涉及用于在广播系统中接收数据的接收机(50)，包括：-广播接收机单元(52)，用于从所述广播系统接收被分段成帧的接收机输入数据流(O′)，其中码字(Z1)的基本码字部分(B)被映射到所述帧上，码字至少包括根据第一码从输入数据字(D)生成的所述基本码字部分(B)，-数据解映射器(54)，用于从接收机输入数据流(O′)的所述帧中解映射出基本码字部分(B)，-解码器(56)，用于利用码字中包括的基本码字部分(B′)在常规解码步骤中对所述码字进行纠错码解码以解码成至少一个输出数据流(I1′，I2′，…，In′)的输出数据字(D′)，-检查单元(58)，用于检查对码字的常规解码是否有错误，-单播请求单元(64)，用于在对码字的所述常规解码有错误的情况下通过单播系统请求错误解码的码字的辅助码字部分(A)来在额外解码步骤中用作递增冗余，-单播接收机单元(68)，用于从所述单播系统接收错误解码的码字的辅助码字部分(A′)，其中所述解码器(56)适应于在额外解码步骤中通过额外地使用接收到的辅助码字部分(A′)来再次对相应的码字解码，以及-数据输出端(60)，用于输出被分段成所述解码出的输出数据字(D′)的所述至少一个接收机输出数据流(I1′，I2′，…，In′)。

    LDPC码矩阵
    99.
    发明公开
    LDPC码矩阵 无效

    公开(公告)号：CN104836635A

    公开(公告)日：2015-08-12

    申请号：CN201510073776.0

    申请日：2015-02-11

    申请人： 熵敏通讯公司

    发明人： 肖·袁 ,  毋宗良 ,  大卫·巴尔 ,  沙哈尔·康斯

    IPC分类号： H04L1/00

    CPC分类号： H03M13/1102 ,  H03M13/036 ,  H03M13/116 ,  H03M13/1177 ,  H03M13/616

    摘要： 本发明涉及LDPC码矩阵。LDPC奇偶校验矩阵包括：系统部分，该系统部分具有多个具有值的系统元素，每个系统元素的值确定待应用至对应于该元素的单位子矩阵的行的循环移位；和奇偶部分，该奇偶部分具有多个具有值的奇偶元素，每个奇偶元素的值确定待应用至对应于该元素的单位子矩阵的行的循环移位；其中，奇偶部分的一组列中的每列的权重相同。LDPC奇偶校验矩阵可以用于数据访问、通信和存储，且可以用于例如多个网络节点之间的通信。