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公开(公告)号：CN114386568A
公开(公告)日：2022-04-22
申请号：CN202111571289.9
申请日：2021-12-21
Applicant: 北京计算机技术及应用研究所
Abstract: 本发明涉及一种基于FPGA的卷积神经网络加速器，属于目标检测技术领域。该方法中，将所述卷积神经网络加速器设计为包括：主机：用于将输入图像数据及权重参数发送给PCIE DMA模块，以及从PCIE DMA模块接收输出结果；运算模块：用于对来自图像数据缓存模块的输入的图像数据和来自权重数据缓存模块的权重参数进行卷积、池化以及逻辑回归运算。本发明通过加速器设计，优化了硬件的能效比，保证了目标检测任务的实时性和稳定性。
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公开(公告)号：CN119225758A
公开(公告)日：2024-12-31
申请号：CN202411248013.0
申请日：2024-09-06
Applicant: 北京计算机技术及应用研究所
IPC: G06F8/65 , G06F15/163 , G06F15/78
Abstract: 本发明涉及一种基于BPI接口逻辑实现FPGA在线升级的系统及方法，属于计算机技术领域。本发明针对FPGA需要远程在线升级应用场景，基于BPI接口的高并行性设计了FPGA在线升级系统及方法，能够实现更优性能的FPGA在线升级系统。
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公开(公告)号：CN116756080A
公开(公告)日：2023-09-15
申请号：CN202310736899.2
申请日：2023-06-21
Applicant: 北京计算机技术及应用研究所
IPC: G06F15/78 , G06F12/0831 , G06F9/50 , G06F12/02 , G06F18/24
Abstract: 本发明涉及一种基于FPGA的TCPIP协议栈的实现方法，属于网络通信技术领域。本发明设计的一种由FPGA纯逻辑实现的TCP/IP协议栈，可与主流操作系统协议栈稳定通信，FPGA协议栈核心代码易于移植，与其它FPGA外围处理逻辑耦合性低；相比传统资源占用率高、性能低的软核轻量级协议栈，本发明的方案由纯逻辑实现，资源占用率低，性能高。
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公开(公告)号：CN116633487A
公开(公告)日：2023-08-22
申请号：CN202310535278.8
申请日：2023-05-12
Applicant: 北京计算机技术及应用研究所
IPC: H04L1/00
Abstract: 本发明涉及一种基于纠错技术的数据链路传输系统及方法，属于数据链路传输技术领域。本发明中，在发送端的数据流中加入冗余编码，接收端根据冗余编码对传输中产生的误码做自动纠错，这种方法拥有较强的纠正突发和随机错误的能力，使接收端不需要请求重发就可以得到正确的数据流，避免了握手和重传，提高了传输效率。同时加入了流控功能，保证了数据流的完整传输。
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公开(公告)号：CN115454901A
公开(公告)日：2022-12-09
申请号：CN202211033710.5
申请日：2022-08-26
Applicant: 北京计算机技术及应用研究所
Abstract: 本发明涉及一种基于FPGA的LVDS高速通信系统及方法，属于LVDS通信技术领域。本发明通过对LVDS电路和对应的FPGA程序模块的设计，实现了FPGA芯片之间的高速通信，并且实现了数据包流控以及错误重传功能，从而实现了可靠传输。
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Patent Agency Ranking
公开(公告)号：CN119322761A
公开(公告)日：2025-01-17
申请号：CN202411319297.8
申请日：2024-09-22
Applicant: 北京计算机技术及应用研究所
Abstract: 本发明涉及一种基于FPGA的PCIe和SRIO接口通道数据转换系统及方法，属于数据转换技术领域。本发明兼容多种数据传输格式，使其不依赖于传输数据中的报文格式；并通过对传输头中的保留字段添加自定义的首包、中间包、尾包标志，实现对多种数据传输格式的支持，省略解析原本报文中的报文信息，减少了数据传输中的时间损耗，传输速率可达最大链路可支持速率的80％；且SRIO通道灵活，可支持多个单路SRIO接口通道。
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公开(公告)号：CN113779320B
公开(公告)日：2024-02-27
申请号：CN202110947466.2
申请日：2021-08-18
Applicant: 北京计算机技术及应用研究所
IPC: G06F16/901 , G06F16/9032 , G06F16/23
Abstract: 本发明涉及一种表项存储地址冲突的解决方法，涉及数据通信技术领域。本发明在配置新增表项时，先用表项关键字缩位计算表项地址，如果地址空闲，直接将表项写入该地址；如果地址被占用，则可能发生了地址冲突，此时读取存储器中表项内容，判断表项内容中的关键字缩位计算得到的地址，是否是表项当前存放的地址，如果是，则判定发生地址冲突，将新增表项通过链表的方式链接到存储器中；如果表项内容中的关键字缩位计算得到的地址，与该表项地址不一致，则将新增表项写入该地址，而将原表项移到另一空闲地址，然后更新原表项链表中“下一个表项地址”字段。本发明既不增加表项存储空间，又能解决表项存储地址冲突问题，同时还能维持较好的处理性能。
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公开(公告)号：CN115665000A
公开(公告)日：2023-01-31
申请号：CN202211275635.3
申请日：2022-10-18
Applicant: 北京计算机技术及应用研究所
IPC: H04L43/08 , H04L43/0823 , H04L43/50
Abstract: 本发明涉及一种基于100G/400GPRBS测试验证链路实现的高速串行总线链路测试方法，属于链路测试技术领域。本发明采取了一种将并行串行思想相结合的方式，使PRBS测试验证链路实现简单，且时序较好，且该PRBS测试验证链路码型随机，符合链路传输要求，但是又有规律，因此可以利用该PRBS测试验证链路进行高速串行总线的链路测试。
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公开(公告)号：CN113346978B
公开(公告)日：2022-07-12
申请号：CN202110563176.8
申请日：2021-05-24
Applicant: 北京计算机技术及应用研究所
Abstract: 本发明涉及一种异步串行LVDS高速稳定传输系统及方法，涉及数据传输技术领域。本发明在发送端对数据流用多项式进行加扰操作，使数据更具有随机性，对数据流用8b/10b编码，保证传输过程中0和1的平衡，通过控制字动态调整接收数据延迟和相位，能够保证接收数据的时序正确性，从而能够保证接收端采样数据的稳定性，利用本发明的异步串行LVDS高速稳定传输系统实现的LVDS接口链路速度最高达1.25G/s。
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公开(公告)号：CN119254846A
公开(公告)日：2025-01-03
申请号：CN202411313613.0
申请日：2024-09-20
Applicant: 北京计算机技术及应用研究所
IPC: H04L69/08 , H04L67/133
Abstract: 本发明涉及一种基于XVC协议的国产FPGA的远程调试系统及方法，属于FPGA调试技术领域。本发明基于XVC(Xilinx Virtual Cable)协议设计了一种适用于国产FPGA的远程调试系统及方法，解决了FPGA远程在线调试及更新问题，优化了国产FPGA的设计调试流程。
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