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公开(公告)号：CN114444537A
公开(公告)日：2022-05-06
申请号：CN202111567057.6
申请日：2021-12-20
Applicant: 北京电子工程总体研究所
IPC: G06K9/00
Abstract: 本发明公开了一种测试数据自动判读系统，包括：数据获取模块、数据预处理模块、数据类型判断模块和数据判读模块；数据获取模块，用于获取预先记录的测试数据；数据预处理模块，用于对获取的测试数据进行预处理；数据类型判断模块，用于根据数据出现跳变的次数，判断测试数据的类型；数据判读模块，用于根据测试数据的不同类型，选择相应的特征提取方法，并基于提取的特征值和预设的阈值，判断数据是否属于异常。本发明首先对输入的数据类型进行判断，然后对不同类型的数据提取其特征，再将特征值与预先设置的阈值或门限进行对比，判断数据是否属于异常数据，采用计算机自动判断的方法，提高了判断的准确性和效率，减少了人力成本。
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公开(公告)号：CN110031809B
公开(公告)日：2021-07-23
申请号：CN201910298233.7
申请日：2019-04-15
Applicant: 北京电子工程总体研究所
IPC: G01S7/40
Abstract: 本发明公开了一种雷达多接收通道幅相一致性标校方法、计算机可读存储介质和计算机设备，所述方法包括：接收从喇叭辐射的预置目标的回波信号并采集多个接收通道的回波原始信号，所述回波信号来源于所述喇叭所接收的由雷达频率综合器产生的多个通道的校准源信号；对各接收通道的所述回波原始信号进行脉冲压缩积累计算获得每个通道的回波信号的幅度和相位，并根据所述幅度和相位获得对应的接收通道的幅相系数；根据各通道的所述幅相系数调整对应的接收通道预设的原幅相系数。本发明提供的方法利用雷达频率综合器产生的校准源信号通过脉压积累达到计算通道幅相系数的目的，使得较低的输入信噪比能够达到较高的校准精度。
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公开(公告)号：CN110554365A
公开(公告)日：2019-12-10
申请号：CN201910821662.8
申请日：2019-09-02
Applicant: 北京电子工程总体研究所
IPC: G01S7/40
Abstract: 本发明公开一种导引头多频点差方向图自动校准方法和装置，包括：S1、设置导引头内的雷达天线指向初始零位，并将导引头对准目标；S2、将雷达天线转动至设定的方位角度和俯仰角度，测量并计算该频点的角误差；S3、重复步骤S2直到计算出所有工作频点的角误差并存储。本发明采用内场实验环境进行校准，采用目标模拟器不动，雷达转动的方法进行雷达差方向图角度零偏、不同角度差斜率的校准，通过软件实现自动化标校。该方法大大提高校准效率和校准精度，对于大带宽极化雷达，只需20分钟便能完成校准和验证，并且该方法灵活性强，可通过装订设置不同频点、不同极化、不同角度步进等参数进行校准，对工程调试有很大的应用价值。
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公开(公告)号：CN110554366A
公开(公告)日：2019-12-10
申请号：CN201910821697.1
申请日：2019-09-02
Applicant: 北京电子工程总体研究所
IPC: G01S7/40
Abstract: 本发明公开一种导引头幅相一致性自动校准方法方法和装置，包括：设置导引头内的雷达天线指向初始零位，并将导引头对准目标；选择校准模式，在对应校准模式下检测雷达每个通道的幅相参数；将检测到的幅相参数与预设的阈值比较，若合格存储并上传至控制台。转动雷达天线到预设角度，重复上述步骤，直到检测出所有工作频点的幅相参数并存储。本发明采用类远场坏境，通过软件设置校准系数达到不同的接收通道数据计算的目的，实现软件的快速自动校准。解决现有手动校准方式工作量大，容易引起错误的问题，具有校准精度高、操作便利、使用灵活、利于排故的优势，同时适合多频点大批量雷达校准调试，大大缩短校准工时。
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Patent Agency Ranking
公开(公告)号：CN110031809A
公开(公告)日：2019-07-19
申请号：CN201910298233.7
申请日：2019-04-15
Applicant: 北京电子工程总体研究所
IPC: G01S7/40
Abstract: 本发明公开了一种雷达多接收通道幅相一致性标校方法、计算机可读存储介质和计算机设备，所述方法包括：接收从喇叭辐射的预置目标的回波信号并采集多个接收通道的回波原始信号，所述回波信号来源于所述喇叭所接收的由雷达频率综合器产生的多个通道的校准源信号；对各接收通道的所述回波原始信号进行脉冲压缩积累计算获得每个通道的回波信号的幅度和相位，并根据所述幅度和相位获得对应的接收通道的幅相系数；根据各通道的所述幅相系数调整对应的接收通道预设的原幅相系数。本发明提供的方法利用雷达频率综合器产生的校准源信号通过脉压积累达到计算通道幅相系数的目的，使得较低的输入信噪比能够达到较高的校准精度。
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公开(公告)号：CN104933670B
公开(公告)日：2018-06-15
申请号：CN201510381417.1
申请日：2015-07-02
Applicant: 北京电子工程总体研究所
IPC: G06T1/00
Abstract: 本发明公开了一种图像像素数据的存储方法，该方法的步骤包括获取待储存图像，确定图像列数M和待储存的任意相邻r2个像素区域；根据所述图像列数M和待存储的任意相邻r2个像素区域，确定系数k＝floor(M/r2)，并进一步获得补充或删除像素列后图像的列数r2×k+r的值；判断补充或删除的图像列的位置；对补充或删除像素列后的图像的像素进行编号；对需要存放图像像素的存储空间进行编号，将上述编号后的图像像素对应的放置与其编号相同的存储空间当中。通过本发明所述技术方案能够实现任意相邻的r2个像素并行处理，其突出特点就是可以同时从存储器中读取相邻r2个像素对应的数据，从而实现对任意相邻的r2个像素并行处理。
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公开(公告)号：CN106778769A
公开(公告)日：2017-05-31
申请号：CN201611037803.X
申请日：2016-11-23
Applicant: 北京电子工程总体研究所
IPC: G06K9/46
Abstract: 本发明公开了一种基于FPGA的弹上图像连通域提取方法，其具体步骤为：搭建包括线段统计模块、标号生成模块、邻接表生成模块和跑长码表输出模块的基于FPGA的弹上图像连通域提取系统，线段统计模块统计二值化图像中每条线段的统计信息，并分别写入双口RAM中形成初始跑长码表，标号生成模块为每条线段生成一个标号，并形成标号表，邻接表生成模块通过判断线段邻接关系，生成相应的邻接表，跑长码表输出模块输出存放于双口RAM中的初始跑长码表、标号表和邻接表。本发明实现了对弹上成像器图像的连通域提取，通过线段统计量的并行计算，获得了比DSP等核心处理器更高的系统实时性和吞吐量。
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公开(公告)号：CN106775573A
公开(公告)日：2017-05-31
申请号：CN201611038362.5
申请日：2016-11-23
Applicant: 北京电子工程总体研究所
IPC: G06F7/02
CPC classification number: G06F7/026
Abstract: 本发明公开了一种基于FPGA的潜在目标排序方法，其具体步骤为：搭建包括输入控制模块、并行比较模块、脉动排序模块和输出控制模块的基于FPGA的潜在目标排序系统；输入控制模块实现对待排序数据集个数N的配置和待排序数据缓存；并行比较模块并行比较待排序数据与已排序数据，并且设置标志位；脉动排序模块利用并行比较标志位进行数据排序；输出控制模块提供排序后数据集读取接口，以供外部读取。本发明实现了对弹上图像处理中潜在目标的排序，利用并行比较结构，获得了比DSP等处理器更高的实时性。
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公开(公告)号：CN104933670A
公开(公告)日：2015-09-23
申请号：CN201510381417.1
申请日：2015-07-02
Applicant: 北京电子工程总体研究所
IPC: G06T1/00
Abstract: 本发明公开了一种图像像素数据的存储方法，该方法的步骤包括获取待储存图像，确定图像列数M和待储存的任意相邻r2个像素区域；根据所述图像列数M和待存储的任意相邻r2个像素区域，确定系数k＝mod(M/r2)，并进一步获得补充或删除像素列后图像的列数r2×k+r的值；判断补充或删除的图像列的位置；对补充或删除像素列后的图像的像素进行编号；对需要存放图像像素的存储空间进行编号，将上述编号后的图像像素对应的放置与其编号相同的存储空间当中。通过本发明所述技术方案能够实现任意相邻的r2个像素并行处理，其突出特点就是可以同时从存储器中读取相邻r2个像素对应的数据，从而实现对任意相邻的r2个像素并行处理。
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