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公开(公告)号：CN116089337A
公开(公告)日：2023-05-09
申请号：CN202211611401.1
申请日：2022-12-14
Applicant: 北京无线电测量研究所
Abstract: 本发明公开一种PCI‑E协议信号生成装置及方法，装置包括：PCI‑E数据流生成模块和高速数字信号调理模块；PCI‑E数据流生成模块用于根据用户设置的数据包内容模拟生成PCI‑E数据流，通过GTX编码并发送PCI‑E数据流中的数据链路层数据包、物理层数据包和事务层数据包；高速数字信号调理模块用于对PCI‑E数据流进行信号调理，并通过信号输出接口输出PCI‑E数据流。本发明能够发送符合PCIE‑2.0协议规范的5Gbps的高速串行数据流，且能自由选择并自动装配出涵盖PCI‑E协议规范中所有关键信息字段的PCI‑E数据包类型；该装置具有较强的可靠性，操作简便，能大大降低操作人员对高速串行PCI‑E协议规范内容的学习时间成本。
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公开(公告)号：CN112327256A
公开(公告)日：2021-02-05
申请号：CN202010951541.8
申请日：2020-09-11
Applicant: 北京无线电测量研究所
IPC: G01S7/282
Abstract: 本发明公开了一种参差脉冲波形产生的方法及系统，所述方法包括：S1：信号源和时钟分发芯片用于时钟分发，为FPGA芯片和DAC芯片提供基础时钟；S2：上位机通过单模光纤发布控制信息至所述FPGA芯片；S3：所述FPGA芯片接收所述控制信息，根据所述控制信息中包含的时序信息和波形信息输出基带波形信号；S4：所述DAC芯片接收所述基带波形信号，将其转换为模拟信号；所述FPGA芯片包括GTX接口模块、控制字解析模块、时序同步信号产生模块、波形参数管理模块、波形产生模块、DAC接口模块和时钟分配和监测模块。
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公开(公告)号：CN110032262B
公开(公告)日：2020-09-18
申请号：CN201910308325.9
申请日：2019-04-17
Applicant: 北京无线电测量研究所
Abstract: 本发明公开一种基于JESD204B接口高速数字收发系统上电配置方法，该方法包括连接高速数字收发系统并上电，对ADC芯片、DAC芯片、LMK04828_AD时钟芯片及LMK04828_DA时钟芯片进行硬件复位；对LMK04828_AD时钟芯片及LMK04828_DA时钟芯片进行第一次寄存器配置，发送SYNC同步信号以及对LMK04828_AD时钟芯片及LMK04828_DA时钟芯片进行第二次寄存器配置；及对FPGA可编程逻辑器的JESD204B接口模块进行复位，对ADC芯片、DAC芯片寄存器进行参数配置，及启动同步监测程序。本发明规范了高速数字收发系统上电配置流程，避免出现时钟撞沿、系统上电不同步或者链路不稳定的情况，同时加入同步监测程序，避免了由于JESD204B接口链路建立失败导致系统崩溃，从而使得系统具有很高的稳定性、抗干扰性、可靠性和环境适应性。
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公开(公告)号：CN117741638A
公开(公告)日：2024-03-22
申请号：CN202311755323.7
申请日：2023-12-19
Applicant: 北京无线电测量研究所
Inventor： 史康为
Abstract: 本发明公开一种开放式软件化雷达频综系统控制架构和方法，包括数字模拟转换器模块、存储控制器模块、存储模块和可编辑门阵列系统，所述数字模拟转换器模块的输出端为所述频综系统的激励信号输出端；所述可编辑门阵列系统包括处理模块，用于接收远程控制信号；可编程逻辑模块，用于为所述数字模拟转换器模块提供波形数据；和数据传输总线模块，用于作为处理模块和可编程逻辑模块之间的数据传输通道。在可编辑门阵列系统内实现监测数据收集模块、文件读写模块、开放式波形数据更新模块、程序远程更新模块，不仅可以远程更新激励波形数据，而且可以远程更新频综系统控制程序，记录故障信息，提高雷达频综系统的调试效率，利于集成探测、通信、干扰等多种功能，降低维护难度。
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公开(公告)号：CN112230189A
公开(公告)日：2021-01-15
申请号：CN202010964964.3
申请日：2020-09-15
Applicant: 北京无线电测量研究所
Inventor： 史康为
IPC: G01S7/40
Abstract: 本发明的一个实施例公开了一种专用雷达阵面远程调试装置和方法，包括光收发模块、标准千兆网模块、网络接口自动切换单元和FPGA可编程逻辑器，其中，所述网络接口自动切换单元接收由所述光收发模块和所述千兆网模块输出的TCP信号，并将所述TCP信号发送给FPGA可编程逻辑器。本发明采用输入输出接口灵活、体积小、成本低、方便拆卸，把输入光接口或千兆网接口最终转换为JTAG接口，实现雷达阵面远程调试，雷达调试完成后拆下该调试设备即可。
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Patent Agency Ranking
公开(公告)号：CN111865461A
公开(公告)日：2020-10-30
申请号：CN202010448239.0
申请日：2020-05-25
Applicant: 北京无线电测量研究所
Abstract: 本发明公开一种宽带多通道数字TR电路，包括：时钟电路，用于发送满足接口要求的采样时钟信号、工作时钟信号与参考同步信号；同步解析模块，接收实时时钟信号以及实时同步信号，解析所述实时同步信号；同步状态测量监测模块，用于接收解析后的实时同步信号，发送至时钟电路，并实时监测所输出的参考同步信号与同步解析模块所输出的实时同步信号之间的相位关系，其中，时钟电路响应于解析后的实时同步信号来对采样时钟信号、工作时钟信号与参考同步信号的初始相位进行清零。本发明能够监测同步状态，达到对宽带多通道AD采样模块、宽带多通道DA采样模块以及FPGA可编辑逻辑器之间的严格同步。
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公开(公告)号：CN116449310A
公开(公告)日：2023-07-18
申请号：CN202211576443.6
申请日：2022-12-09
Applicant: 北京无线电测量研究所
Abstract: 本发明实施例公开一种Ka波段星载SAR雷达频综接收机，所述频综接收机包括发射信号产生单元、接收机和标频模块，其中，所述发射信号产生单元，用于产生激励信号和测试信号并输出；所述接收机，用于接收天线回波信号进行下变频和C波段解调后输出基带IQ信号；所述标频模块，用于输出时钟信号、一本振信号和二本振信号至所述发射信号产生单元和接收机。本实施例采用数字方式直接产生920MHz宽带信号，提高了雷达系统分辨率，其产生的信号带宽大且保证了宽带信号质量。
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公开(公告)号：CN113054953A
公开(公告)日：2021-06-29
申请号：CN202110319490.1
申请日：2021-03-25
Applicant: 北京无线电测量研究所
Abstract: 本发明公开了一种宽带波形产生组件和方法，所述组件包括：FPGA可编程逻辑处理器、高速ADC和高速DAC；所述FPGA可编程逻辑器用于接收外部控制信号和所述高速ADC输入的采样数据，根据所述输入控制信号实时产生线性调频信号并进行失真和滤波处理后转换为串行信号输出至所述高速DAC，所述高速DAC对其进行数模转换后输出宽带波形信号。本发明在FPGA可编程逻辑器内实现了多通道参数化波形产生模块、预失真滤波器模块和滤波器系数计算模块，不仅可以实时、参数化产生任意带宽、脉宽的宽带线性调频波形，而且可以自适应预失真，提高组件的预失真的效率。
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公开(公告)号：CN109100695B
公开(公告)日：2021-02-12
申请号：CN201811242916.2
申请日：2018-10-24
Applicant: 北京无线电测量研究所
IPC: G01S7/40
Abstract: 本发明公开了一种宽带数字阵列雷达的数字延时补偿系统，包括时延参数解析模块，用于在接收状态时，接收第一控制信息，根据所述第一控制信息计算接收通道的接收延时参数，并在发射状态时，接收第二控制信息，根据所述第二控制信息计算发射通道的发射延时参数；信号处理模块，用于将输入的接收信号处理得到接收基带信号；第一数字分数延时滤波器，用于根据所述接收延时参数对所述接收基带信号进行延时；波形产生模块，用于形成发射信号；第二数字分数延时滤波器，用于根据所述发射延时参数对所述发射信号进行延时，本发明还公开了宽带数字阵列雷达的数字延时补偿方法，本发明可采用数字延时补偿，具有数字化、无额外硬件资源和延时精度高的特点。
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公开(公告)号：CN109100695A
公开(公告)日：2018-12-28
申请号：CN201811242916.2
申请日：2018-10-24
Applicant: 北京无线电测量研究所
IPC: G01S7/40
Abstract: 本发明公开了一种宽带数字阵列雷达的数字延时补偿系统，包括时延参数解析模块，用于在接收状态时，接收第一控制信息，根据所述第一控制信息计算接收通道的接收延时参数，并在发射状态时，接收第二控制信息，根据所述第二控制信息计算发射通道的发射延时参数；信号处理模块，用于将输入的接收信号处理得到接收基带信号；第一数字分数延时滤波器，用于根据所述接收延时参数对所述接收基带信号进行延时；波形产生模块，用于形成发射信号；第二数字分数延时滤波器，用于根据所述发射延时参数对所述发射信号进行延时，本发明还公开了宽带数字阵列雷达的数字延时补偿方法，本发明可采用数字延时补偿，具有数字化、无额外硬件资源和延时精度高的特点。
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