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公开(公告)号：CN113886297B
公开(公告)日：2023-12-01
申请号：CN202111137786.8
申请日：2021-09-27
Applicant: 北京中电华大电子设计有限责任公司
Abstract: 本发明公开了一种基于DMA的SPI并发通讯SE装置及方法,属于通信技术领域。本发明通过：1)SPI接口模块增加接收通道与发送通道可开关机制，以及SPI接口模块引入自动发送转接收功能，以较低的设计成本与较好的兼容性，解决市面上常规DMA传输方法不能适应SPI总线特性(全双工与同步机制)的问题，同时很好的适应了SPI与其余接口并发通讯场景下的互相干扰问题；2)DMA模块增加外设请求传输停止信号，SPI接口模块增加接收与发送完成中断，同时给DMA模块发送高电平请求，强制接收或发送数据完成时停止DMA传输，以较小的设计代价解决了通过SPI接口传输时，主机MCU端与从机SE端收发数据长度不匹配时的异常问题，提高了SPI与其余接口并发通讯场景下的传输可靠性。
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公开(公告)号：CN107832250B
公开(公告)日：2020-10-30
申请号：CN201711061933.1
申请日：2017-11-02
Applicant: 北京中电华大电子设计有限责任公司
Abstract: 本发明公开了一种基于SPI的主从通讯系统及可靠传输方法,属于通信技术领域。所述方法包括：一方面提供一种基于SPI接口的主从通讯时序方法：即从SPI设备关闭SPI模块后，主SPI的SS信号线与从SPI的握手线相连，该握手线可以与从SPI的SS信号复用，也可以为从SPI设备的一个GPIO引脚；另一方面提供了一种基于SPI接口的主从数据可靠传输方法，引入数据链路层和应用层，数据链路层拥有出错重发处理机制。通过上述方法，本发明解决了SPI接口通讯时序匹配困难与通讯可靠性较低的缺陷，且方案易于实现，硬件成本低，可靠性高，传输效率高，兼容性好。
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公开(公告)号：CN107832250A
公开(公告)日：2018-03-23
申请号：CN201711061933.1
申请日：2017-11-02
Applicant: 北京中电华大电子设计有限责任公司
Abstract: 本发明公开了一种基于SPI的主从通讯系统及可靠传输方法,属于通信技术领域。所述方法包括：一方面提供一种基于SPI接口的主从通讯时序方法：即从SPI设备关闭SPI模块后，主SPI的SS信号线与从SPI的握手线相连，该握手线可以与从SPI的SS信号复用，也可以为从SPI设备的一个GPIO引脚；另一方面提供了一种基于SPI接口的主从数据可靠传输方法，引入数据链路层和应用层，数据链路层拥有出错重发处理机制。通过上述方法，本发明解决了SPI接口通讯时序匹配困难与通讯可靠性较低的缺陷，且方案易于实现，硬件成本低，可靠性高，传输效率高，兼容性好。
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公开(公告)号：CN118821244A
公开(公告)日：2024-10-22
申请号：CN202410921071.9
申请日：2024-07-10
Applicant: 北京中电华大电子设计有限责任公司
Abstract: 本发明公开了一种基于SPI的并行加解密通讯装置及方法。本发明装置包括SPI Flash主控制器模块，对称算法加解密模块，PUF模块与DMA模块，SPI Flash主控制器与CPU和DMA模块相连，用于与SPI Flash存储器件通讯时，CPU配置SPI Flash控制器通讯参数，并通过DMA模块自动搬移数据，对称算法加密模块与CPU模块和PUF模块相连，用于实现对通讯数据的加解密。本发明中SPI Flash主控制器模块与对称算法加解密模块，两模块总线间没有直接通讯，提高了加解密模块的复用性；利用SPI Flash存储器件的读写命令执行特性、总线数据传输速度与对称算法CTR模式加解密速度，将往SPI Flash存储器件传输的读写命令通讯时间与加解密时间并行运行，降低了执行成本，同时提高了加解密通讯效率。
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公开(公告)号：CN113886297A
公开(公告)日：2022-01-04
申请号：CN202111137786.8
申请日：2021-09-27
Applicant: 北京中电华大电子设计有限责任公司
Abstract: 本发明公开了一种基于DMA的SPI并发通讯SE装置及方法,属于通信技术领域。本发明通过：1)SPI接口模块增加接收通道与发送通道可开关机制，以及SPI接口模块引入自动发送转接收功能，以较低的设计成本与较好的兼容性，解决市面上常规DMA传输方法不能适应SPI总线特性(全双工与同步机制)的问题，同时很好的适应了SPI与其余接口并发通讯场景下的互相干扰问题；2)DMA模块增加外设请求传输停止信号，SPI接口模块增加接收与发送完成中断，同时给DMA模块发送高电平请求，强制接收或发送数据完成时停止DMA传输，以较小的设计代价解决了通过SPI接口传输时，主机MCU端与从机SE端收发数据长度不匹配时的异常问题，提高了SPI与其余接口并发通讯场景下的传输可靠性。
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