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公开(公告)号:CN107112948A
公开(公告)日:2017-08-29
申请号:CN201580072692.3
申请日:2015-11-20
Applicant: 高通股份有限公司
IPC: H03B5/12
CPC classification number: H03B5/1262 , H03B5/1203 , H03B5/1206 , H03B5/1209 , H03B5/1228 , H03B5/1243 , H03B5/1265 , H03B5/129
Abstract: 公开了用于偏置频率振荡器以最小化相位噪声的系统和方法。系统可以包括具有电感器、至少第一耦合电容器和第二耦合电容器的储能电路。系统可以进一步包括电耦合至第一耦合电容器和第二耦合电容器的变容二极管电路。系统可以进一步包括与储能电路和偏置电压并联电连接的至少一个第一金属氧化物半导体(MOS)器件。至少一个第一MOS器件可以电连接至第一栅极偏置电压,配置用于偏置至少一个第一MOS器件以使得至少一个第一MOS器件的第一栅极至源极电压保持低于第一阈值电压。
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公开(公告)号:CN107925411A
公开(公告)日:2018-04-17
申请号:CN201680048315.0
申请日:2016-07-26
Applicant: 高通股份有限公司
IPC: H03L7/00
Abstract: 用于使用脉冲吞没来使不同LO路径中的分频器同步的方法和装置。一个示例装置一般地包括:第一路径,其具有被配置为从第一周期信号生成第一分频信号的第一分频器;第二路径,其具有被配置为从第二周期信号生成第二分频信号的第二分频器;相位检测器,其被配置为比较基于第一分频信号的第一感测信号的相位和基于第二分频信号的第二感测信号的相位,并且如果第一感测信号和第二感测信号异相则生成第一触发信号;以及第一脉冲抑制器,其被配置为响应于第一触发信号而将第一周期信号的脉冲抑制至少一个周期以调节第一分频信号的相位。
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公开(公告)号:CN107925411B
公开(公告)日:2022-01-28
申请号:CN201680048315.0
申请日:2016-07-26
Applicant: 高通股份有限公司
IPC: H03L7/00
Abstract: 用于使用脉冲吞没来使不同LO路径中的分频器同步的方法和装置。一个示例装置一般地包括:第一路径,其具有被配置为从第一周期信号生成第一分频信号的第一分频器;第二路径,其具有被配置为从第二周期信号生成第二分频信号的第二分频器;相位检测器,其被配置为比较基于第一分频信号的第一感测信号的相位和基于第二分频信号的第二感测信号的相位,并且如果第一感测信号和第二感测信号异相则生成第一触发信号;以及第一脉冲抑制器,其被配置为响应于第一触发信号而将第一周期信号的脉冲抑制至少一个周期以调节第一分频信号的相位。
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