一种基于FPGA的新型时钟控制方法及系统

    公开(公告)号:CN119759177A

    公开(公告)日:2025-04-04

    申请号:CN202411816046.0

    申请日:2024-12-11

    Abstract: 本发明提供了一种基于FPGA的新型时钟控制方法及系统,涉及信号处理技术领域;本发明提供的系统包括:VCXO压控晶振、数模转换器、PLL锁相环模块、DDMTD测量模块和自适应钟控模块;锁相环实现、鉴相算法和钟控算法基于FPGA单芯片执行,硬件设计复杂度低;本发明使用数字双混频时差法(DDMTD)测量获取时钟鉴相结果,配合动态PID钟控算法,快速调整本地时钟频率,实现本地时钟和时钟源之间频率以及相位的快速跟踪和锁定;本发明动态PID钟控算法根据所在状态、时钟频率偏差大小和时钟相位差大小实时动态调整PID算法的参数P,使其具备锁定能力更强,收敛时间更短,反应更迅速的优点。

    用于无线双向信道的动态模拟系统及方法

    公开(公告)号:CN115314136A

    公开(公告)日:2022-11-08

    申请号:CN202210835286.X

    申请日:2022-07-15

    Inventor: 曹骏 马亚

    Abstract: 本发明公开了用于无线双向信道的动态模拟系统及方法,涉及通信领域,系统包括导入模块、输入AD模块、模拟计算模块、缓存模块、动态模拟模块和时延模块;方法包括S1导入每个待测试节点设备的初始位置和动态位置,输入待测试节点设备的数字信号,S2模拟待测试节点设备的相关参数信息,S3根据相关参数信息模拟分析从待测试节点设备m到待测试节点设备n的总时延,S4延迟储存的数字信号和相关参数信息后传输到动态模拟模块,S5进行信号传输模拟;可以实现模拟双向无线信道在收发设备运动状态下的无线信号动态变化;为高速运动条件下无线通信设备的开发和测试提供了一种方便的测试手段;为基于双向无线通信的时间同步设备提供了有效的性能测试手段。

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