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公开(公告)号：CN115473861B
公开(公告)日：2023-11-03
申请号：CN202210991611.1
申请日：2022-08-18
Applicant: 珠海高凌信息科技股份有限公司
IPC: H04L49/10 , H04L49/15 , H04L67/568 , H04L69/16 , H04L69/329
Abstract: 本申请公开了基于通信与计算分离的高性能处理系统和方法、存储介质，本申请的系统包括TOE节点、PCIe交换节点、CPU节点；所述TOE节点用于系统对外的TCP或IP通信，以及将TCP或IP数据终端化；所述PCIe交换节点用于通过DMA方式将应用层数据运送到软件的用户缓冲区；所述CPU节点用于运行基于应用的功能软件，完成系统的应用计算功能。本申请能够提高整个系统的处理性能，降低对CPU的处理能力占用，是一种工程中切实可行的高性能处理系统构建方案。
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公开(公告)号：CN115460039B
公开(公告)日：2023-07-11
申请号：CN202210988322.6
申请日：2022-08-17
Applicant: 珠海高凌信息科技股份有限公司
Abstract: 本申请公开了基于逻辑网络的大容量TDM交换系统和方法、存储介质，本申请的系统通过逻辑功能子网与物理承载子网的模型抽象，从系统层面将数据计算与数据通信任务进行分离。由于系统层面的解耦，运行于逻辑功能节点上的功能软件可以专注于功能本身，可以将对应功能软件设计成移植性良好的实体，能够降低功能软件开发实现门槛和TDM交换系统的工程实现难度，降低设计成本、生产成本、架设成本和维护成本。
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公开(公告)号：CN116340197A
公开(公告)日：2023-06-27
申请号：CN202310202954.X
申请日：2023-03-03
Applicant: 珠海高凌信息科技股份有限公司
IPC: G06F12/02 , G06F12/0862
Abstract: 本发明提供一种基于FPGA实现的套接字描述符调度系统及其方法，该系统包括存储单元，用于提供描述符的存储空间，其包括一个存储大池和两个存储小池；其中，第一个存储小池为回收资源池，第二个存储小池为预取资源池；存储大池为描述符的主要存储资源池；管理单元，用于控制描述符的产生和回收，以及负责描述符在三个资源池之间的运行；粘合单元，用于在描述符运行期间，提供临时缓冲区。应用本发明可以解决现有技术中存储资源紧张，资源消耗大等问题，充分调用了整个FPGA的存储资源，克服了现有方法占用存储资源过多的缺点。
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Patent Agency Ranking
公开(公告)号：CN115473861A
公开(公告)日：2022-12-13
申请号：CN202210991611.1
申请日：2022-08-18
Applicant: 珠海高凌信息科技股份有限公司
IPC: H04L49/10 , H04L49/15 , H04L67/568 , H04L69/16 , H04L69/329
Abstract: 本申请公开了基于通信与计算分离的高性能处理系统和方法、存储介质，本申请的系统包括TOE节点、PCIe交换节点、CPU节点；所述TOE节点用于系统对外的TCP或IP通信，以及将TCP或IP数据终端化；所述PCIe交换节点用于通过DMA方式将应用层数据运送到软件的用户缓冲区；所述CPU节点用于运行基于应用的功能软件，完成系统的应用计算功能。本申请能够提高整个系统的处理性能，降低对CPU的处理能力占用，是一种工程中切实可行的高性能处理系统构建方案。
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公开(公告)号：CN115174345A
公开(公告)日：2022-10-11
申请号：CN202210678412.5
申请日：2022-06-16
Applicant: 珠海高凌信息科技股份有限公司
IPC: H04L41/046 , H04L69/22
Abstract: 本申请公开了一种FPGA透明代理系统、方法及装置，本申请的系统包括MAC层处理模块、报头解析模块、数据缓存模块、主动自适应整形引擎模块、数据裁决模块。本申请的数据处理流程中不需要额外缓存，便于硬件实现，可以对数据进行线速处理，解决了并发过高会带来的丢包问题，通过合理的数据结构提取，减小了需要维护的状态向量规模，具备更高的安全性和通用适配性。
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公开(公告)号：CN115174345B
公开(公告)日：2023-11-03
申请号：CN202210678412.5
申请日：2022-06-16
Applicant: 珠海高凌信息科技股份有限公司
IPC: H04L47/22 , H04L69/163 , H04L67/568
Abstract: 本申请公开了一种FPGA透明代理系统、方法及装置，本申请的系统包括MAC层处理模块、报头解析模块、数据缓存模块、主动自适应整形引擎模块、数据裁决模块。本申请的数据处理流程中不需要额外缓存，便于硬件实现，可以对数据进行线速处理，解决了并发过高会带来的丢包问题，通过合理的数据结构提取，减小了需要维护的状态向量规模，具备更高的安全性和通用适配性。
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公开(公告)号：CN116319551A
公开(公告)日：2023-06-23
申请号：CN202310201880.8
申请日：2023-03-03
Applicant: 珠海高凌信息科技股份有限公司
IPC: H04L45/745 , H04L45/7453
Abstract: 本发明提供一种基于FPGA实现的高效网络流表设计方法，其包括构造以HASH表为主存储器、CAM表为辅存储器的HASH‑CAM流表；将获取到的KEY值拷贝为两份，第一份通过哈希算法计算后，将HASH值作为HASH表的访问地址，第二份直接进入CAM表；HASH表和CAM表分别并行进行表项访问，各自输出结果；将HASH表和CAM表的访问结果，通过裁决器进行判决，输出表项的访问结果；其中，对HASH‑CAM流表的访问，包括查找、新建修改、删除等功能。本发明基于高效哈希表与CAM表相结合，以大容量哈希表结合小容量CAM表的方法，构造以哈希表为主存储器、CAM表为辅存储器的联合存储结构体，来减小和处理哈希冲突。
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公开(公告)号：CN115460039A
公开(公告)日：2022-12-09
申请号：CN202210988322.6
申请日：2022-08-17
Applicant: 珠海高凌信息科技股份有限公司
Abstract: 本申请公开了基于逻辑网络的大容量TDM交换系统和方法、存储介质，本申请的系统通过逻辑功能子网与物理承载子网的模型抽象，从系统层面将数据计算与数据通信任务进行分离。由于系统层面的解耦，运行于逻辑功能节点上的功能软件可以专注于功能本身，可以将对应功能软件设计成移植性良好的实体，能够降低功能软件开发实现门槛和TDM交换系统的工程实现难度，降低设计成本、生产成本、架设成本和维护成本。
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