跳频同步系统、方法、装置、计算机设备和存储介质

    公开(公告)号:CN113271120A

    公开(公告)日:2021-08-17

    申请号:CN202010097852.2

    申请日:2020-02-17

    Abstract: 本申请涉及一种跳频同步系统、方法、装置、计算机设备和存储介质。所述系统包括发送端和接收端,所述发送端,用于为数据帧配置同步帧,得到同步数据帧;根据预设的跳频频点,发送多个同步数据帧;跳频频点包括同步帧跳频频点和数据帧跳频频点;数据帧跳频频点与所述同步帧跳频频点相关联;所述接收端,用于接收多个同步数据帧,并从多个同步数据帧中提取多个同步帧;通过拼接多个同步帧,得到同步帧跳频频点,并根据同步帧跳频频点确定数据帧跳频频点;根据数据帧跳频频点,对数据帧进行跳频同步。采用本系统便于实现快速跳频,提高跳频抗干扰能力,以及在复杂电磁干扰条件下确保快速可靠同步。

    宽带抗强干扰变频接收机与卫星通信设备

    公开(公告)号:CN118473437A

    公开(公告)日:2024-08-09

    申请号:CN202310102152.1

    申请日:2023-02-08

    Abstract: 本发明涉及卫星通信技术领域,提供一种宽带抗强干扰变频接收机与卫星通信设备。上述宽带抗干扰变频接收机包括射频处理单元、第一混频处理单元和第二混频处理单元;射频处理单元、第一混频处理单元和第二混频处理单元依次连接,构建了超外差二次变频接收电路;射频处理单元包括至少两级高速跳频带通滤波器和射频调谐放大器;至少两级高速跳频带通滤波器和射频调谐放大器串联;通过配置至少两级高速跳频带通滤波器的中心频率进行交叠或扩展,在实现滤波的同时,适配窄带、宽带等多种带宽的射频信号。本发明的接收机具有频率范围宽、抗阻塞干扰能力强、适用高速跳频通信的特点,能够在宽带跳频强干扰或强阻塞条件下进行可靠地接收通信。

    一种跳频发生装置

    公开(公告)号:CN115733514A

    公开(公告)日:2023-03-03

    申请号:CN202111021616.3

    申请日:2021-09-01

    Abstract: 本发明提供一种跳频发生装置,包括主控制模块、频率直接合成模块、锁相环模块和倍频模块;主控制模块分别与频率直接合成模块以及锁相环模块连接;频率直接合成模块分别与锁相环模块以及倍频模块连接;倍频模块包括若干个级联的子倍频模块,子倍频模块包括带通滤波器、放大器和倍频器;主控制模块发送第一控制信号至锁相环模块,发送第二控制信号至频率直接合成模块,频率直接合成模块根据时钟信号以及第二控制信号生成跳频信号,将其输出至倍频模块,倍频模块的若干个级联的子倍频模块对跳频信号进行倍频处理和杂散处理,将处理后的跳频信号作为本振信号输出。装置输出的本振信号具备频率高、跳频速率高、相位连续和杂散低的优点。

    跳频同步系统、方法、装置、计算机设备和存储介质

    公开(公告)号:CN113271120B

    公开(公告)日:2022-09-13

    申请号:CN202010097852.2

    申请日:2020-02-17

    Abstract: 本申请涉及一种跳频同步系统、方法、装置、计算机设备和存储介质。所述系统包括发送端和接收端,所述发送端,用于为数据帧配置同步帧,得到同步数据帧;根据预设的跳频频点,发送多个同步数据帧;跳频频点包括同步帧跳频频点和数据帧跳频频点;数据帧跳频频点与所述同步帧跳频频点相关联;所述接收端,用于接收多个同步数据帧,并从多个同步数据帧中提取多个同步帧;通过拼接多个同步帧,得到同步帧跳频频点,并根据同步帧跳频频点确定数据帧跳频频点;根据数据帧跳频频点,对数据帧进行跳频同步。采用本系统便于实现快速跳频,提高跳频抗干扰能力,以及在复杂电磁干扰条件下确保快速可靠同步。

    跳频本振模块、跳频变频模块及地面通信设备

    公开(公告)号:CN115811331A

    公开(公告)日:2023-03-17

    申请号:CN202111075617.6

    申请日:2021-09-14

    Abstract: 本发明提供跳频本振模块、跳频变频模块及地面通信设备,跳频本振模块包括:锁相环单元、第一混频器和直接数字频率合成器;锁相环单元分别与直接数字频率合成器以及第一混频器连接;直接数字频率合成器与第一混频器连接;锁相环单元产生至少两路本振信号,一路输出至直接数字频率合成器作为其时钟信号,另一路输出至第一混频器;直接数字频率合成器根据时钟信号生成第一跳频信号并输出至第一混频器;第一混频器将接收到的本振信号与第一跳频信号混频,将混频后的信号作为第二跳频信号并输出。直接数字频率合成器为跳频核心,锁相环单元输出的一路本振信号作为其时钟信号,另一路本振信号与跳频信号混频得到相位连续且跳频速率高的跳频信号。

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