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公开(公告)号：CN102841797B
公开(公告)日：2017-03-01
申请号：CN201210015504.1
申请日：2012-01-18
Applicant: 富士施乐株式会社
IPC: G06F9/445
CPC classification number: G06F9/4411 , G06F9/4401
Abstract: 本发明提供了程序执行设备、图像处理设备和程序执行方法。该程序执行设备包括：非易失性存储器，其存储用于启动装备的程序和在该程序中所使用的变量，并且即使未供电其也保持所存储的程序和变量，该程序和变量能够被读出以及写入非易失性存储器中；执行单元，当在程序和变量未被存储在非易失性存储器的初始状态下指示启动该装备时，将所述程序和所述变量传送至非易失性存储器，并且接连地使用存储在非易失性存储器中的所述变量来执行所述程序，而且当再次指示启动装备时，使用存储在非易失性存储器中的所述变量来执行所述程序。
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公开(公告)号：CN103309425B
公开(公告)日：2016-12-21
申请号：CN201210447942.5
申请日：2012-11-09
Applicant: 富士施乐株式会社
CPC classification number: G06K15/02 , G06K15/40 , G06K15/406
Abstract: 本发明提供了一种图像形成装置和信息处理装置。图像形成装置包括：形成图像的图像形成单元和控制图像形成单元的控制器，其中控制器包括：执行第一程序的第一执行单元；第一主存储器，其包括第一非易失性存储器，连接至第一执行单元并且存储第一启动程序；第一发送和接收控制器，其连接至第一总线，控制数据的发送和接收并且包括易失性存储器；第二执行单元，其连接至第一执行单元并且执行第二程序；第二主存储器，其包括第二非易失性存储器，连接至所述第二执行单元并且存储第二启动程序；以及第二发送和接收控制器，其连接至第二总线，控制数据的发送和接收并且包括第三方易失性存储器。
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公开(公告)号：CN102841797A
公开(公告)日：2012-12-26
申请号：CN201210015504.1
申请日：2012-01-18
Applicant: 富士施乐株式会社
IPC: G06F9/445
CPC classification number: G06F9/4411 , G06F9/4401
Abstract: 本发明提供了程序执行设备、图像处理设备和程序执行方法。该程序执行设备包括：非易失性存储器，其存储用于启动装备的程序和在该程序中所使用的变量，并且即使未供电其也保持所存储的程序和变量，该程序和变量能够被读出以及写入非易失性存储器中；执行单元，当在程序和变量未被存储在非易失性存储器的初始状态下指示启动该装备时，将所述程序和所述变量传送至非易失性存储器，并且接连地使用存储在非易失性存储器中的所述变量来执行所述程序，而且当再次指示启动装备时，使用存储在非易失性存储器中的所述变量来执行所述程序。
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公开(公告)号：CN105812501B
公开(公告)日：2019-07-02
申请号：CN201510640602.8
申请日：2015-09-30
Applicant: 富士施乐株式会社
IPC: H04L29/12
CPC classification number: H04L61/103 , H04L49/40 , H04L61/6009 , H04L61/6022
Abstract: 本发明公开了一种响应装置、信息处理装置、响应方法和信息处理方法。所述响应装置包括存储器、接收单元和响应单元。所述存储器存储在通信电路中的逻辑地址和物理地址，所述逻辑地址和所述物理地址被分配至被连接至所述通信电路的外部信息处理装置，所述响应装置被连接至所述通信电路。所述接收单元从所述通信电路接收请求物理地址的地址请求。所述响应单元在所接收的地址请求的目的地址与所存储的所述信息处理装置的逻辑地址相等的情况下，以所存储的所述信息处理装置的物理地址作出响应。
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公开(公告)号：CN106021140B
公开(公告)日：2019-05-07
申请号：CN201510644464.0
申请日：2015-10-08
Applicant: 富士施乐株式会社
IPC: G06F13/16
Abstract: 本发明公开了一种信息处理装置和信息处理方法，所述信息处理装置包括：从多个外部装置依次获取请求的请求获取单元；存储所述请求的请求存储器；获取超时值的超时值获取单元，每个所述超时值表示直到停止发送来自所述多个外部装置中的一个的请求的时间；在获取请求的情况下，判定所述请求存储器是否具有附加存储所述请求的足够的空间的判定单元；以及在所述判定单元判定所述请求存储器不具有足够的空间的情况下，丢弃根据由所述超时值获取单元获取的所述超时值选择的请求的丢弃单元。
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Patent Agency Ranking
公开(公告)号：CN105988553A
公开(公告)日：2016-10-05
申请号：CN201510548063.5
申请日：2015-08-31
Applicant: 富士施乐株式会社
Abstract: 本发明公开了一种省电控制装置、信息处理装置以及省电控制方法，该省电控制装置包括设定单元以及模式控制器。所述设定单元设定使得处于省电模式的信息处理装置进行从通信线路接收数据的操作的时段，在所述省电模式下比第一模式节省更多的电力。所述模式控制器在所述信息处理装置处于所述省电模式的情况下，在当前时间处于设定时段以内时将所述信息处理装置设定为进行所述接收操作的第二模式，并且在当前时间处于设定时段以外时将所述信息处理装置设定为停止所述接收操作的第三模式。
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公开(公告)号：CN105676990A
公开(公告)日：2016-06-15
申请号：CN201510390454.9
申请日：2015-07-06
Applicant: 富士施乐株式会社
CPC classification number: H04N1/00891 , G06F1/24 , G06F1/3206 , G06F1/3209 , G06F1/3243 , G06F1/3284 , G06F1/3287 , G06F1/3293 , H04N1/00204 , H04N1/00896 , H04N2201/0094
Abstract: 本发明公开了一种信息处理装置、图像处理装置、图像形成装置及控制方法，该信息处理装置包括第一中央处理单元、第二中央处理单元以及返回单元。所述第一中央处理单元具有正常操作状态和省电状态，所述省电状态下的耗电量低于所述正常操作状态下的耗电量。所述第二中央处理单元使得所述第一中央处理单元从所述省电状态返回所述正常操作状态。所述返回单元使得所述第一中央处理单元，在所述第一中央处理单元进入所述省电状态之后所述第二中央处理单元进入异常状态的情况下，返回所述正常操作状态。
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公开(公告)号：CN106021140A
公开(公告)日：2016-10-12
申请号：CN201510644464.0
申请日：2015-10-08
Applicant: 富士施乐株式会社
IPC: G06F13/16
CPC classification number: G06F12/023
Abstract: 本发明公开了一种信息处理装置和信息处理方法，所述信息处理装置包括：从多个外部装置依次获取请求的请求获取单元；存储所述请求的请求存储器；获取超时值的超时值获取单元，每个所述超时值表示直到停止发送来自所述多个外部装置中的一个的请求的时间；在获取请求的情况下，判定所述请求存储器是否具有附加存储所述请求的足够的空间的判定单元；以及在所述判定单元判定所述请求存储器不具有足够的空间的情况下，丢弃根据由所述超时值获取单元获取的所述超时值选择的请求的丢弃单元。
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公开(公告)号：CN105988552A
公开(公告)日：2016-10-05
申请号：CN201510546915.7
申请日：2015-08-31
Applicant: 富士施乐株式会社
IPC: G06F1/32
CPC classification number: H04L49/65 , G06F1/3243 , G06F1/3293 , Y02D10/122 , Y02D10/152
Abstract: 本发明公开了一种信息处理装置以及信息处理方法，该信息处理装置包括：网络接口、主运算单元、副运算单元以及数据开关。所述主运算单元响应于向其供给的电源而被启动，并基于预设第一程序进行运算操作。所述副运算单元基于由所述主运算单元写入的第二程序进行运算操作。所述数据开关在所述副运算单元的控制下，切换在所述网络接口和所述主运算单元或所述副运算单元之间的数据通信的路径。所述数据开关构成为，在初始状态，在所述网络接口和所述主运算单元之间进行所述数据的通信。
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公开(公告)号：CN105812501A
公开(公告)日：2016-07-27
申请号：CN201510640602.8
申请日：2015-09-30
Applicant: 富士施乐株式会社
IPC: H04L29/12
CPC classification number: H04L61/103 , H04L49/40 , H04L61/6009 , H04L61/6022
Abstract: 本发明公开了一种响应装置、信息处理装置、响应方法和信息处理方法。所述响应装置包括存储器、接收单元和响应单元。所述存储器存储在通信电路中的逻辑地址和物理地址，所述逻辑地址和所述物理地址被分配至被连接至所述通信电路的外部信息处理装置，所述响应装置被连接至所述通信电路。所述接收单元从所述通信电路接收请求物理地址的地址请求。所述响应单元在所接收的地址请求的目的地址与所存储的所述信息处理装置的逻辑地址相等的情况下，以所存储的所述信息处理装置的物理地址作出响应。
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