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公开(公告)号:CN102064799B
公开(公告)日:2014-06-04
申请号:CN201010622722.2
申请日:2010-12-31
Applicant: 南京理工大学
Abstract: 本发明公开了一种基于FPGA的去偏转换量测卡尔曼滤波器的设计方法,首先设计基于FPGA的去偏转换量测卡尔曼滤波的系统,增益矩阵模块包含平均真实协方差子模块和增益矩阵子模块;状态更新模块包含坐标转换子模块、平均真实偏差子模块、新息子模块和状态更新子模块;所述的三角函数模块、一步预测模块、预测误差协方差模块、滤波误差协方差模块、平均真实协方差子模块、增益矩阵子模块、坐标转换子模块、平均真实偏差子模块、新息子模块和状态更新子模块分别调用了浮点加、减、乘、除运算模块。本发明采用结构层次化设计,底层模块运用VHDL输入,顶层采用原理图输入方式,可提高代码的可读性,易于模块划分,且方便在设计过程中进行仿真。
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公开(公告)号:CN102064799A
公开(公告)日:2011-05-18
申请号:CN201010622722.2
申请日:2010-12-31
Applicant: 南京理工大学
Abstract: 本发明公开了一种基于FPGA的去偏转换量测卡尔曼滤波器的设计方法,首先设计基于FPGA的去偏转换量测卡尔曼滤波的系统,增益矩阵模块包含平均真实协方差子模块和增益矩阵子模块;状态更新模块包含坐标转换子模块、平均真实偏差子模块、新息子模块和状态更新子模块;所述的三角函数模块、一步预测模块、预测误差协方差模块、滤波误差协方差模块、平均真实协方差子模块、增益矩阵子模块、坐标转换子模块、平均真实偏差子模块、新息子模块和状态更新子模块分别调用了浮点加、减、乘、除运算模块。本发明采用结构层次化设计,底层模块运用VHDL输入,顶层采用原理图输入方式,可提高代码的可读性,易于模块划分,且方便在设计过程中进行仿真。
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