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发明公开
基于算术检错编码的处理器流水线及防御故障注入的方法审中-实审

公开(公告)号：CN116383811A

公开(公告)日：2023-07-04

申请号：CN202310285162.3

申请日：2023-03-22

Applicant: 北京邮电大学

Inventor： 冯帅虎 , 吕勇强 , 邱朋飞 , 汪东升 , 孙日晖 , 王春露

IPC: G06F21/55 , G06F21/56 , G06F21/64 , G06F11/10

Abstract: 本发明公开了一种基于算术检错编码的处理器流水线及防御故障注入的方法，所述基于算术检错编码的处理器流水线包括处理器五级流水线、数据缓存、寄存器堆、检错编码数据区、数据完整性校验逻辑、检错编码生成逻辑、容错计算逻辑以及内存；所述可防御故障注入攻击的方法将算术检错编码应用于处理器指令流水线，在寄存器和数据缓存的数据存取过程中实现数据完整性校验和指令执行阶段的算术容错计算，在体系结构层面防御针对处理器的故障注入攻击，提高处理器硬件可靠性。

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