一种正反相输入级电路
    1.
    发明授权

    公开(公告)号:CN116505934B

    公开(公告)日:2024-02-02

    申请号:CN202310587468.4

    申请日:2023-05-24

    Abstract: 本发明公开了一种正反相输入级电路,包括正相输入端口、反相输入端口、电源端口、接地端口、上下拉模块、正相通路模块、反相通路模块和输出端口,上下拉模块能够将无输入的正相输入端口上拉、将无输入的反相输入端口下拉,正相通路模块包括分别由第五晶体管、第九晶体管;第四晶体管、第十一晶体管;第六晶体管、第十晶体管构成的三个反相器;反相通路模块包括分别由第二晶体管、第八晶体管;第三晶体管、第十二晶体管;第六晶体管、第十晶体管构成的三个反相器。连接正相输入端口,输出端的波形将与正相输入端口同相,连接反相输入端口,输出端的波形将与反相输入端口反相。本发明能够在同一芯片或芯片的同一通道实现正相或反相的输出。

    一种基于电阻阵列模块的多基准电压产生电路及方法

    公开(公告)号:CN116204025B

    公开(公告)日:2025-04-11

    申请号:CN202211682915.6

    申请日:2022-12-27

    Abstract: 本发明实施例公开一种基于电阻阵列模块的多基准电压产生电路及方法。在一具体实施方式中,该模块包括译码器、N个串联连接的电阻和连接在各电阻和译码器之间的开关;其中所述译码器接收选择信号和栅压控制信号,输出开关控制信号至所述开关;所述开关响应于所述开关控制信号,选择对应的电阻接入所述模块。该实施方式实现可供芯片需要提供不同的基准电压值,在同一款芯片中更具备兼容性和准确性,并大大提高集成度,减少重复电路。

    一种正反相输入级电路
    3.
    发明公开

    公开(公告)号:CN116505934A

    公开(公告)日:2023-07-28

    申请号:CN202310587468.4

    申请日:2023-05-24

    Abstract: 本发明公开了一种正反相输入级电路,包括正相输入端口、反相输入端口、电源端口、接地端口、上下拉模块、正相通路模块、反相通路模块和输出端口,上下拉模块能够将无输入的正相输入端口上拉、将无输入的反相输入端口下拉,正相通路模块包括分别由第五晶体管、第九晶体管;第四晶体管、第十一晶体管;第六晶体管、第十晶体管构成的三个反相器;反相通路模块包括分别由第二晶体管、第八晶体管;第三晶体管、第十二晶体管;第六晶体管、第十晶体管构成的三个反相器。连接正相输入端口,输出端的波形将与正相输入端口同相,连接反相输入端口,输出端的波形将与反相输入端口反相。本发明能够在同一芯片或芯片的同一通道实现正相或反相的输出。

    一种数字信号生成电路
    4.
    发明公开

    公开(公告)号:CN115586811A

    公开(公告)日:2023-01-10

    申请号:CN202211257024.6

    申请日:2022-10-14

    Abstract: 本发明实施例公开一种数字信号生成电路,所述电路包括数控电流源、电流镜、第一电阻器、第二电阻器、第一缓冲器链、第二缓冲器链、输出下拉晶体管和输出上拉晶体管,其中,所述数控电流源用于根据指令产生电流信号;所述电流镜用于对所述数控电流源输出的电流信号进行镜像转换;所述第一电阻器将经过的电流信号转换为第一电压信号;所述第二电阻器将经过的电流信号转化为第二电压信号;所述第一电压信号在所述第一缓冲器链驱动输出下拉晶体管的栅极,第二电压信号通过第二缓冲器链驱动输出上拉晶体管的栅极,由此在输出下拉晶体管和输出上拉晶体管之间输出高压数字信号。

    一种基于电阻阵列模块的多基准电压产生电路及方法

    公开(公告)号:CN116204025A

    公开(公告)日:2023-06-02

    申请号:CN202211682915.6

    申请日:2022-12-27

    Abstract: 本发明实施例公开一种基于电阻阵列模块的多基准电压产生电路及方法。在一具体实施方式中,该模块包括译码器、N个串联连接的电阻和连接在各电阻和译码器之间的开关;其中所述译码器接收选择信号和栅压控制信号,输出开关控制信号至所述开关;所述开关响应于所述开关控制信号,选择对应的电阻接入所述模块。该实施方式实现可供芯片需要提供不同的基准电压值,在同一款芯片中更具备兼容性和准确性,并大大提高集成度,减少重复电路。

    一种数字信号生成电路
    6.
    发明授权

    公开(公告)号:CN115586811B

    公开(公告)日:2023-10-20

    申请号:CN202211257024.6

    申请日:2022-10-14

    Abstract: 本发明实施例公开一种数字信号生成电路,所述电路包括数控电流源、电流镜、第一电阻器、第二电阻器、第一缓冲器链、第二缓冲器链、输出下拉晶体管和输出上拉晶体管,其中,所述数控电流源用于根据指令产生电流信号;所述电流镜用于对所述数控电流源输出的电流信号进行镜像转换;所述第一电阻器将经过的电流信号转换为第一电压信号;所述第二电阻器将经过的电流信号转化为第二电压信号;所述第一电压信号在所述第一缓冲器链驱动输出下拉晶体管的栅极,第二电压信号通过第二缓冲器链驱动输出上拉晶体管的栅极,由此在输出下拉晶体管和输出上拉晶体管之间输出高压数字信号。

    一种死区时间的控制电路及方法
    7.
    发明公开

    公开(公告)号:CN116015042A

    公开(公告)日:2023-04-25

    申请号:CN202211683399.9

    申请日:2022-12-27

    Abstract: 本发明实施例公开一种死区时间的控制电路及方法。在一具体实施方式中,该电路包括反馈电路,用于根据调制信号为高电平时,产生第一使能信号和第二使能信号;其中,所述第一使能信号为低电平,用于控制下管关闭;浮动地电路,用于根据第二使能信号为高电平时输出上管栅极控制信号;上管栅极电位检测电路,用于根据所述上管栅极控制信号为低电平时打开上管。该实施方式实现了在无任何人工设置干预的情况下,会自动调整泄放延迟时间,以确保上下管无对通,且泄放延迟尽可能小,从而防止较大的峰值电流将功率管和芯片烧毁,确保芯片性能的同时提高芯片的可靠性。

Patent Agency Ranking