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公开(公告)号：CN110429937B
公开(公告)日：2023-02-21
申请号：CN201910639317.2
申请日：2019-07-16
Applicant: 东南大学
Abstract: 本发明公开了一种用于提高SAR‑ISDM混合结构ADC采样率的实现电路及方法，电路包括模数转换器ADC1和ADC2、一个逻辑单元（104）及一个数字计数器（105），模数转换器ADC1包括一个数模转换器DAC1（100）和一个时域比较器TDC1（102），模数转换器ADC2包括一个数模转换器DAC2（101）和一个时域比较器TDC2（103）；数模转换器DAC1（100）和DAC2（101）均由10位的电容阵列和一个Cisdm电容构成，时域比较器TDC1（102）和时域比较器TDC2（103）均由一对差分的VCDL单元和一个量化器构成。本发明通过两个ADC实现了SAR转换与ISDM流水线工作，在不增加硬件开销前提下以较低的功耗成本实现了采样率的有效提升，有效提升了ADC转换速率，以满足ADC在更高采样率下的应用。
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Patent Agency Ranking
公开(公告)号：CN110995269B
公开(公告)日：2022-11-18
申请号：CN201911080864.8
申请日：2019-11-07
Applicant: 东南大学
IPC: H03M1/46
Abstract: 本发明公开了一种适用于低电压SAR ADC设计的节能开关切换电路及其方法，属于集成电路设计技术领域，电路包括：P端采样开关（101）、N端采样开关（102）、DAC阵列、P端开关阵列（107）和N端开关阵列（108）、比较器（109）、SAR逻辑单元（110），其中DAC阵列包括P端MSB子阵列（103）、P端LSB子阵列（104）、N端MSB子阵列（105）、N端LSB子阵列（106）。本发明将MSB分裂结构与合并分离技术相结合，使得开关切换能量相比于传统切换算法减少了99.76%，同时避免了第三参考电平的使用，兼具能量及线性度的优势，尤其适合低电压ADC设计。
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公开(公告)号：CN109412593B
公开(公告)日：2022-06-03
申请号：CN201811036460.4
申请日：2018-09-06
Applicant: 东南大学
Abstract: 本发明公开了一种部分分裂流水线逐次逼近型ADC数字校准电路，属于基本电子电路的技术领域，尤其涉及流水线‑逐次逼近型模数转换器的后台校准方法。整体架构由两级逐次逼近型ADC构成，前级包括DAC模块、比较器模块、近似检测器和SAR逻辑模块，后级包括两个相同的分离ADC，两级之间通过余量放大器模块连接。通过采用后级分离ADC结构并将输出码作差的方式，在数字域实现了一种DAC实际位权重的校准方法。电路结构简单，显著改善由电容失配和运放有限增益导致的信噪失真比下降，提高ADC整体转换精度，优化电路性能。
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公开(公告)号：CN110429937A
公开(公告)日：2019-11-08
申请号：CN201910639317.2
申请日：2019-07-16
Applicant: 东南大学
Abstract: 本发明公开了一种用于提高SAR-ISDM混合结构ADC采样率的实现电路及方法，电路包括模数转换器ADC1和ADC2、一个逻辑单元（104）及一个数字计数器（105），模数转换器ADC1包括一个数模转换器DAC1（100）和一个时域比较器TDC1（102），模数转换器ADC2包括一个数模转换器DAC2（101）和一个时域比较器TDC2（103）；数模转换器DAC1（100）和DAC2（101）均由10位的电容阵列和一个Cisdm电容构成，时域比较器TDC1（102）和时域比较器TDC2（103）均由一对差分的VCDL单元和一个量化器构成。本发明通过两个ADC实现了SAR转换与ISDM流水线工作，在不增加硬件开销前提下以较低的功耗成本实现了采样率的有效提升，有效提升了ADC转换速率，以满足ADC在更高采样率下的应用。
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公开(公告)号：CN110995269A
公开(公告)日：2020-04-10
申请号：CN201911080864.8
申请日：2019-11-07
Applicant: 东南大学
IPC: H03M1/46
Abstract: 本发明公开了一种适用于低电压SAR ADC设计的节能开关切换电路及其方法，属于集成电路设计技术领域，电路包括：P端采样开关（101）、N端采样开关（102）、DAC阵列、P端开关阵列（107）和N端开关阵列（108）、比较器（109）、SAR逻辑单元（110），其中DAC阵列包括P端MSB子阵列（103）、P端LSB子阵列（104）、N端MSB子阵列（105）、N端LSB子阵列（106）。本发明将MSB分裂结构与合并分离技术相结合，使得开关切换能量相比于传统切换算法减少了99.76%，同时避免了第三参考电平的使用，兼具能量及线性度的优势，尤其适合低电压ADC设计。
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公开(公告)号：CN109412593A
公开(公告)日：2019-03-01
申请号：CN201811036460.4
申请日：2018-09-06
Applicant: 东南大学
Abstract: 本发明公开了一种部分分裂流水线逐次逼近型ADC数字校准电路，属于基本电子电路的技术领域，尤其涉及流水线-逐次逼近型模数转换器的后台校准方法。整体架构由两级逐次逼近型ADC构成，前级包括DAC模块、比较器模块、近似检测器和SAR逻辑模块，后级包括两个相同的分离ADC，两级之间通过余量放大器模块连接。通过采用后级分离ADC结构并将输出码作差的方式，在数字域实现了一种DAC实际位权重的校准方法。电路结构简单，显著改善由电容失配和运放有限增益导致的信噪失真比下降，提高ADC整体转换精度，优化电路性能。
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