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公开(公告)号：CN110086489A
公开(公告)日：2019-08-02
申请号：CN201910392087.4
申请日：2019-05-13
Applicant: 福州大学
Inventor： 阴亚东
Abstract: 本发明提出一种免中断式超再生接收机频率校准电路及工作方法，其特征在于，包括：高频分频器、振荡幅度检测单元、第一延迟单元、第二延迟单元、第三延迟单元、第一周期计数单元、第二周期计数单元、第一采样保持单元、第二采样保持单元、第一周期计数单元、第二周期计数单元、鉴相器、控制单元和振荡调谐电路。其能够在不中断超再生接收机的接收状态下，实现对接收机中振荡器振荡频率的精确校准，以提升接收机的灵敏度和选择性。该方案可广泛使用到基于超再生接收机的无线电路系统中，以提高其性能指标。
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公开(公告)号：CN105978541B
公开(公告)日：2019-05-10
申请号：CN201610275107.6
申请日：2016-04-28
Applicant: 福州大学
Inventor： 阴亚东
IPC: H03K5/19
Abstract: 本发明涉及一种可实现快速信号跟踪的方法，按照如下方式实现：延时单元对第一信号SIGA延时处理，产生由n路延迟信号构成的延迟信号组；采样单元从第一信号和延迟信号组中挑选出m路信号构成第一输入信号组，结合第二信号SIGB采样处理，并产生由m路采样信号构成的采样信号组；判决单元从延迟信号组中挑选出m路子信号，使之与采样信号组中m路子信号一一对应，根据判决规则对采样信号组中各子信号的状态进行监测，当采样信号组中子信号满足判决规则时，从满足判决规则的采样信号组子信号中挑选出1路子信号作为判决信号并触发产生判决操作，将判决信号对应的延迟信号组子信号作为输出信号SIGO并维持到下一次判决发生，实现对第二信号SIGB的跟踪。
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公开(公告)号：CN106160740B
公开(公告)日：2019-03-12
申请号：CN201610594381.X
申请日：2016-07-27
Applicant: 福州大学
IPC: H03L7/10
Abstract: 本发明涉及一种间歇式锁相环频率综合器，包括时钟同步单元、锁相环单元以及模式控制单元；时钟同步单元分别与模式控制单元以及锁相环单元相连；模式控制单元与所相环单元相连；时钟同步单元以及模式控制单元作为输入端，分别接收参考时钟信号以及模式控制信号；模式控制单元接收时钟同步单元发送的同步时钟信号；锁相环单元接收模式控制信号发送的第一复位信号以及第二复位信号，接收时钟同步单元发送的同步时钟信号，并分别发送反馈时钟信号至时钟同步单元以及模式控制单元；锁相环单元作为输出端，输出一高频时钟信号。本发明所提出的一种间歇式锁相环频率综合器，其能够工作在开启时间短于锁相环锁定时间的间歇工作模式。
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公开(公告)号：CN105471527B
公开(公告)日：2018-05-25
申请号：CN201510768913.2
申请日：2015-11-12
Applicant: 福州大学
Inventor： 阴亚东
IPC: H04B17/318 , H04L27/06
Abstract: 本发明涉及一种可实现跨标准通信的无线通信方法，包括以下步骤：步骤S1：提供一第一无线装置作为数据发射端，一可实现无线信号强度检测的第二无线装置作为数据接收端；步骤S2：第一无线装置与第二无线装置不必采用相同的无线通信协议标准，但工作于相同频段；步骤S3：数据发送端按自身无线通信协议生成数据包并发射，数据包的内容不必为所需传输数据的内容；步骤S4：所需传输数据的内容采用数据包发射过程中形成的信号包络进行调制表达；步骤S5：数据接收端检测数据发送端发送的数据包的无线信号强度，在提取出数据包所形成的信号包络后解调得出所需传输数据的内容。本发明在对无线装置改动最小的情况下，能够实现不同无线通信标准之间互联互通。
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Patent Agency Ranking
公开(公告)号：CN106788443A
公开(公告)日：2017-05-31
申请号：CN201611053295.4
申请日：2016-11-25
Applicant: 福州大学
IPC: H03M3/00
Abstract: 本发明涉及一种改进型的MASH结构 Sigma‑Delta调制器，包括一第一调制器单元模块和由一级以上依次级联的调制器级联单元模块组成的级联模块组；所述第一调制器单元模块与级联模块组相级联；所述第一调制器单元模块由第一调制器和第一加法器组成；所述第一调制器的输出端与级联模块组的输入端连接，所述第一加法器的输入端与所述第一调制器的输出端和级联模块组的输出端电连，所述第一调制器单元模块的输入端为第一调制器的输入端，所述第一调制器单元模块的输出端为第一加法器的输出端。本发明的有益效果在于：结构简单，并且操作更加方便，本发明提供的Sigma‑Delta调制器输出的序列长度与输入值和初始条件无关。
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公开(公告)号：CN106160740A
公开(公告)日：2016-11-23
申请号：CN201610594381.X
申请日：2016-07-27
Applicant: 福州大学
IPC: H03L7/10
CPC classification number: H03L7/104
Abstract: 本发明涉及一种间歇式锁相环频率综合器，包括时钟同步单元、锁相环单元以及模式控制单元；时钟同步单元分别与模式控制单元以及锁相环单元相连；模式控制单元与所相环单元相连；时钟同步单元以及模式控制单元作为输入端，分别接收参考时钟信号以及模式控制信号；模式控制单元接收时钟同步单元发送的同步时钟信号；锁相环单元接收模式控制信号发送的第一复位信号以及第二复位信号，接收时钟同步单元发送的同步时钟信号，并分别发送反馈时钟信号至时钟同步单元以及模式控制单元；锁相环单元作为输出端，输出一高频时钟信号。本发明所提出的一种间歇式锁相环频率综合器，其能够工作在开启时间短于锁相环锁定时间的间歇工作模式。
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公开(公告)号：CN119758695A
公开(公告)日：2025-04-04
申请号：CN202510026951.4
申请日：2025-01-08
Applicant: 福州大学
IPC: G04F10/00
Abstract: 本发明提出一种时间数字转换器电路及其工作方法，所述时间数字转换器电路包括依次连接的逻辑控制模块、量化器和读出电路；所述时间数字转换器电路用以根据输入的复位信号RST、系统时钟CKS和待量化信号TIN，输出数据可读信号RDY和量化码D0‑DN。本发明能够通过基于时间寄存器的时间数字转换器对时间进行量化，所提出的电路和实现方式具有功耗低、可靠性高等优点，并且可以广泛使用到激光测距仪、荧光寿命成像显微镜等相关的应用中。
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