系统存储器延时补偿
    11.
    发明公开

    公开(公告)号:CN110651233A

    公开(公告)日:2020-01-03

    申请号:CN201880033385.8

    申请日:2018-03-26

    Abstract: 可以补偿在以降低的频率进行操作的存储器系统中的流水线逻辑延时。可以至少使用第一时钟信号和第二时钟信号来控制流水线逻辑。当存储器系统以较高的频率进行操作时,可以使用第一时钟信号来控制流水线逻辑的全部寄存器。然而,当存储器系统以降低的频率进行操作时,可以使用第一时钟信号来控制一个或多个寄存器,以及可以使用第二时钟信号来控制一个或多个其它寄存器。

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