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公开(公告)号：CN102483701A
公开(公告)日：2012-05-30
申请号：CN201180003692.X
申请日：2011-07-04
Applicant: 松下电器产业株式会社
IPC: G06F9/45
Abstract: 程序生成装置参照包含将块重复处理N次的、有关第i次执行的上述块内定义的变量处于在有关第j次执行的上述块内被参照的相关关系的循环处理的源程序，计算有关第i次的执行的上述块及有关第i次以外的执行的1个以上的上述块中的变量表述的等价关系，对于处于上述相关关系的全部的对象变量的表述，确定与该对象变量的表述等价的不具有上述相关关系的其他变量的表述，生成用来进行上述循环处理的M次的处理的、包括包含有所确定的其他变量的表述的命令语句的程序，其中N≥2，1≤i＜N，i＜j≤N，M≤N。
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公开(公告)号：CN100557565C
公开(公告)日：2009-11-04
申请号：CN200510113272.3
申请日：2005-07-06
Applicant: 松下电器产业株式会社
IPC: G06F9/38
CPC classification number: G06F9/3877 , G06F9/3885
Abstract: 一种具备主处理器和协处理器的运算处理装置，主处理器具有：根据运算指令进行运算时用于保存运算对象或结果的多个寄存器、和逐次解释指令并进行根据指令的控制的指令解释控制部，此指令解释控制部利用操作数来指定：在上述协处理器中应执行的运算处理的种类、表示保存该运算处理对象的第一寄存器的信息和表示应保存上述协处理器进行运算处理的结果的第二寄存器的信息，通过解释用于请求向协处理器的运算的1条指令即协处理器运算指令，从而进行下述控制：在上述协处理器中，将第一寄存器的内容作为运算处理对象以执行该种类的运算处理，进而将由上述协处理器生成的此运算处理结果写入第二寄存器。
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公开(公告)号：CN101346695A
公开(公告)日：2009-01-14
申请号：CN200680049373.1
申请日：2006-11-09
Applicant: 松下电器产业株式会社
IPC: G06F9/38
CPC classification number: G06F9/3885 , G06F9/30014 , G06F9/30181 , G06F9/3897
Abstract: 安装了执行指令的多个运算器的处理器(101)包括：固定功能运算器(121～123)，具有不可动态重构的电路结构；可重构运算器(125)，具有可动态重构的电路结构；以及运算控制部(113)，将不存在数据的依赖性的指令群中的指令，分别分配给固定功能运算器(121～123)以及可重构运算器(125)，并且，将分别被分配的指令发行给接受分配方。
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公开(公告)号：CN101010671A
公开(公告)日：2007-08-01
申请号：CN200580026332.6
申请日：2005-08-02
Applicant: 松下电器产业株式会社
IPC: G06F15/80
CPC classification number: G06F15/8007 , G06F1/3203 , G06F9/3842 , G06F9/3885 , H04N19/43 , H04N19/61
Abstract: 一种阵列式运算装置，具有由依次配置的多个处理器单元构成的处理器阵列；在每一个周期发行1个指令；在每一个周期，制作用于控制最初的处理器单元的动作的动作控制信息，根据制作的动作控制信息和1个指令，生成对最初的处理器单元的指令；根据为了控制前1个处理器单元的动作而制作的动作控制信息，制作用于控制其它处理器单元的动作的动作控制信息；根据制作的动作控制信息和由上述指令取得单元取得的1个指令，生成对上述处理器单元的指令。
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公开(公告)号：CN1383529A
公开(公告)日：2002-12-04
申请号：CN01801735.5
申请日：2001-04-23
Applicant: 松下电器产业株式会社
Abstract: 本发明是用以执行滤波处理的像素运算装置,设有16个像素处理部分1～16及用以供给16个像素数据与滤波器系数的输入缓冲器群22;各像素处理部分,在用输入缓冲器群22供给的像素数据与滤波器系数进行运算后,从邻接的像素处理部分取得像素数据,用所取得的像素数据运算并将运算结果累积。通过重复进行这样的取得与累积操作,进行按重复次数而定的抽头数的滤波处理。
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Patent Agency Ranking
公开(公告)号：CN103168289A
公开(公告)日：2013-06-19
申请号：CN201280003250.X
申请日：2012-09-11
Applicant: 松下电器产业株式会社
CPC classification number: G06F17/30244 , G06F9/30032 , G06F9/30036 , G06F9/30109
Abstract: 寄存器组，能够保存矩阵数据，能够以要素数据单位读出；输出数据重排部，按每个行数据进行重排，以使同一列的要素数据分别属于不同的列；寄存器访问部，将重排后的矩阵数据写入寄存器组，使用列位置信息从寄存器组读出要素数据的集合，上述列位置信息表示属于同一列的要素数据在寄存器组中被存储的场所；输入数据重排部，将所读出的要素数据的集合重排；运算处理部，对重排后的要素数据的集合进行运算；以及转置控制部，生成重排信息和列位置信息，控制数据的重排；通过在向寄存器组保存时和读出时进行数据串的重排，使转置处理高速化。
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公开(公告)号：CN102067088A
公开(公告)日：2011-05-18
申请号：CN200980122843.6
申请日：2009-06-16
Applicant: 松下电器产业株式会社
Inventor： 森下广之
CPC classification number: G06F9/544 , G06F9/3009 , G06F9/30123 , G06F9/3851 , G06F9/3857 , G06F9/3877 , G06F9/3885
Abstract: 提供一种多处理器，不会降低处理效率的多处理器，而能够处理多个线程。该多处理器包括：第一处理器，对多个线程中的作为执行对象的规定个数的线程分别分配不同的寄存器文件，并行进行所分配的各线程的处理；以及第二处理器，进行对应于所述第一处理器的指示的处理，所述第一处理器具有按照所述多个线程的每个线程分配的存储区域，按照执行对象的一个线程所包含的指令，向所述第二处理器进行处理委托，若从所述第二处理器接收到对该线程的处理结果的值的写入请求，则判断在当前时点该线程是否为执行对象，在判断为不是执行对象的情况下，控制为向分配给该线程的存储区域写入所述处理结果的值。
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公开(公告)号：CN100429632C
公开(公告)日：2008-10-29
申请号：CN200480027074.9
申请日：2004-08-23
Applicant: 松下电器产业株式会社
CPC classification number: G06F12/127 , G06F12/124
Abstract: 本发明的高速缓冲存储器，具有：通路(0)～通路(3)，对每个高速缓冲项目存储表示有无访问的使用标志U；以及控制部，在命中时，将与该高速缓冲项目相对应的使用标志U更新为有访问，此时组内的其他全部的使用标志表示有访问的情况下，将组内的其他全部的使用标志复位为无访问，从与表示无访问的使用标志U相对应的高速缓冲项目中选择置换对象的高速缓冲项目。
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公开(公告)号：CN101198940A
公开(公告)日：2008-06-11
申请号：CN200680021374.5
申请日：2006-06-06
Applicant: 松下电器产业株式会社
CPC classification number: G06F13/385
Abstract: 地址控制部(114)根据从主设备(101)的向外部设备(102)的写入请求，将来自主设备(101)的写入地址(150)和写入数据(151)分别存储到写入地址存储部(110)和写入数据存储部(111)，并且将受理信号(155)输出到主设备，而且，对由写入地址指定的外部设备(102)，写入该写入数据，在由主设备(101)将读出地址存储到读出地址存储部(112)时，从由该读出地址指定的外部设备(102)读出数据，并存储到读出数据存储部(113)。
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公开(公告)号：CN1307574C
公开(公告)日：2007-03-28
申请号：CN03106891.X
申请日：2003-03-06
Applicant: 松下电器产业株式会社
CPC classification number: G06F9/3012 , G06F9/30036 , G06F9/3824 , G06F9/3885
Abstract: 数据处理装置包括16个具有寄存器文件和算术运算单元的处理元件，寄存器文件和算术运算单元之间由网络部连接。网络部具有同时实施多个将某个处理元件内的寄存器文件作为输入源，将某个处理元件内的运算单元作为输出目的地的输入输出的选择器。选择器实现同时输入输出，使得即便操作符的分配等产生变化，也可普遍地维持处理元件的运转效率。
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