时序信号生成方法、装置、逻辑电路板及存储介质

    公开(公告)号:CN110362524A

    公开(公告)日:2019-10-22

    申请号:CN201810322102.3

    申请日:2018-04-11

    Inventor: 瞿勇 徐春晖 杜皓

    Abstract: 本发明实施例提供了时序信号生成方法、装置、逻辑电路板及存储介质,该方法包括:接收主设备发送的时序设置指令,时序设置指令中携带针对待交互I2C设备的时序信号的时序片段的种类及顺序;按照时序设置指令中时序信号的时序片段的种类及顺序,生成目标时序信号。在本发明实施例的时序信号生成方法中,按照时序设置指令中时序信号的时序片段的种类及顺序,生成目标时序信号,可以生产指定类型的时序信号,从而满足不同种类的I2C设备的时序。在添加新的I2C设备后,不必添加新的寄存器,通过时序设置指令实现生成符合新的I2C设备的时序的时序信号,能够便于对新添加I2C设备的使用,节约时间成本。

    一种实现文件交互的系统及方法

    公开(公告)号:CN102855208B

    公开(公告)日:2015-06-17

    申请号:CN201110189508.7

    申请日:2011-06-30

    Abstract: 本发明提供了一种实现文件交互的系统及方法,主设备通过PCIe总线连接至少一个从设备,经由从文件头的地址、PCIe文件头的地址、及主文件头的地址形成文件头信息的传输路径,经由从设备地址、PCIe文件的地址、及主设备地址形成待操作文件的传输路;主设备将文件头信息写入主文件头的地址,将待操作文件写入主设备地址、或从主设备地址读取待操作文件;从设备根据从文件头的地址中的文件头信息,将从设备地址中的待操作文件写入文件头信息包含的存储路径、或将存储路径下的待操作文件写入从设备地址。采用本发明的系统及方法,能够无需复杂的协商及额外的硬件,通过PCIe总线实现两个设备间的文件交互,降低了硬件成本和复杂性。

    并行系统间数据传输方法及其系统

    公开(公告)号:CN102752223B

    公开(公告)日:2014-11-05

    申请号:CN201210261307.8

    申请日:2012-07-26

    Inventor: 曹洪坤 杜皓

    Abstract: 本发明涉及计算机及通信领域,公开了一种并行系统间数据传输方法及其系统。本发明中,通过PCIe总线连接多个并行系统,每个系统为各其它系统分别建一个缓冲区描述符和接收缓冲区,将数据传到接收系统中相应的接收缓冲区,并设置缓冲区描述符中的信息,等接收系统读取,可以在多个并行系统中建立起一个底层的网络,实现各系统之间自由的数据传输。在发送系统的发送描述符和接收系统的接收描述符中设置对应的读位置和写位置,由发送系统通过PCIe总线更新接收系统中的写位置,由接收系统通过PCIe总线更新发送系统中的读位置,而不是将描述符中的读位置和写位置全由本地系统更新,可以进一步缩短数据传输流程所需要时间。

    多处理器系统及其并行启动方法

    公开(公告)号:CN102646045B

    公开(公告)日:2016-02-10

    申请号:CN201210059600.6

    申请日:2012-03-08

    Inventor: 杨克勤 瞿勇 杜皓

    Abstract: 本发明涉及多处理器计算机系统,公开了一种多处理器系统及其并行启动方法。实现了主处理器和从处理器启动并行化,加快了多处理器系统启动加载速度,减少了用户等待时间。本发明中,系统包括:由总线连接的至少两个处理器,其中一个为主处理器,其他为从处理器;方法包括以下步骤:主处理器启动主引导程序,并枚举总线上的从处理器;主引导程序为从处理器加载启动文件后,启动从处理器;在启动从处理器的同时,主处理器加载自身的操作系统内核镜像文件并启动。

    多处理器系统及其并行启动方法

    公开(公告)号:CN102646045A

    公开(公告)日:2012-08-22

    申请号:CN201210059600.6

    申请日:2012-03-08

    Inventor: 杨克勤 瞿勇 杜皓

    Abstract: 本发明涉及多处理器计算机系统,公开了一种多处理器系统及其并行启动方法。实现了主处理器和从处理器启动并行化,加快了多处理器系统启动加载速度,减少了用户等待时间。本发明中,系统包括:由总线连接的至少两个处理器,其中一个为主处理器,其他为从处理器;方法包括以下步骤:主处理器启动主引导程序,并枚举总线上的从处理器;主引导程序为从处理器加载启动文件后,启动从处理器;在启动从处理器的同时,主处理器加载自身的操作系统内核镜像文件并启动。

    多子板PCI-E系统热插拔子板检测方法及其装置

    公开(公告)号:CN102609344A

    公开(公告)日:2012-07-25

    申请号:CN201210034885.8

    申请日:2012-02-16

    Inventor: 瞿勇 杨克勤 杜皓

    Abstract: 本发明涉及计算机通信领域,公开了一种多子板PCI-E系统热插拔子板检测方法及其装置。既加快了启动过程,提高了启动效率,又能够在绝大部分情况下自动恢复子板的运行和正常连接。本发明中,包括以下步骤:系统中主处理器的内核启动后,获取该系统当前所有PCI-E槽位的子板信息;根据子板信息对各槽位分别判断是否存在子板和子板是否PCI-E连接正常;对于判定为存在子板且子板PCI-E连接不正常的槽位,先后执行热拔程序和热插程序。

    一种数据传输方法、装置、电子设备及机器可读存储介质

    公开(公告)号:CN112822226A

    公开(公告)日:2021-05-18

    申请号:CN201911121393.0

    申请日:2019-11-15

    Inventor: 瞿勇 杜皓

    Abstract: 本发明实施例提供了一种数据传输方法、装置、电子设备及机器可读存储介质,接收端接收发送端发送的传输信号,根据传输信号每一位的电平状态,检测传输信号的起始位、各数据位及停止位,统计各数据位的数据位时长,并基于预先设定的数据位时长与数值的对应关系,识别各数据位对应的数值,基于起始位与停止位之间各数据位对应的数值,确定接收到由各数据位对应的数值组成的数据。传输信号每两个相邻位的电平状态不同,基于电平状态检测出传输信号的各数据位,基于预先设定的数据位时长与数值的对应关系,识别出各数据位的数值,既能够保证准确检测到传输信号的各数据位,又能够保证准确识别出各数据位的具体数值,保证接收端接收到准确的数据。

    时序信号生成方法、装置、逻辑电路板及存储介质

    公开(公告)号:CN110362524B

    公开(公告)日:2021-04-09

    申请号:CN201810322102.3

    申请日:2018-04-11

    Inventor: 瞿勇 徐春晖 杜皓

    Abstract: 本发明实施例提供了时序信号生成方法、装置、逻辑电路板及存储介质,该方法包括:接收主设备发送的时序设置指令,时序设置指令中携带针对待交互I2C设备的时序信号的时序片段的种类及顺序;按照时序设置指令中时序信号的时序片段的种类及顺序,生成目标时序信号。在本发明实施例的时序信号生成方法中,按照时序设置指令中时序信号的时序片段的种类及顺序,生成目标时序信号,可以生产指定类型的时序信号,从而满足不同种类的I2C设备的时序。在添加新的I2C设备后,不必添加新的寄存器,通过时序设置指令实现生成符合新的I2C设备的时序的时序信号,能够便于对新添加I2C设备的使用,节约时间成本。

    一种引导加载程序升级方法、装置、电子设备及存储介质

    公开(公告)号:CN112527371A

    公开(公告)日:2021-03-19

    申请号:CN202011494888.0

    申请日:2020-12-17

    Inventor: 瞿勇 杜皓

    Abstract: 本申请实施例提供了一种引导加载程序升级方法、装置、电子设备及存储介质,涉及计算机技术领域,包括:所述引导加载程序安装于电子设备中,所述引导加载程序包括:第一程序和第二程序,所述第一程序用于引导所述电子设备的操作系统内核启动以及调用所述第二程序,所述第二程序用于实现除启动所述操作系统内核外的其他功能,所述方法包括:在所述第一程序或所述操作系统内核处于工作状态的情况下,若需要对所述引导加载程序进行升级,获得所述第二程序的升级文件;基于所述升级文件对所述第二程序进行升级,以实现对所述引导加载程序升级。应用本申请实施例提供的引导加载程序升级方案,可以降低升级引导加载程序的风险。

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