Invention Publication
- Patent Title: 具有耦合衬底的半导体器件封装件
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Application No.: CN202380043303.9Application Date: 2023-10-17
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Publication No.: CN119498030APublication Date: 2025-02-21
- Inventor: G·P·R·阿姆贝卡 , 马赫什·A , K·安贾尼尤鲁
- Applicant: 桑迪士克科技股份有限公司
- Applicant Address: 美国加利福尼亚州
- Assignee: 桑迪士克科技股份有限公司
- Current Assignee: 桑迪士克科技股份有限公司
- Current Assignee Address: 美国加利福尼亚州
- Agency: 北京市柳沈律师事务所
- Agent 李芳华
- Priority: 63/387,328 20221214 US 18/361,118 20230728 US
- International Application: PCT/US2023/077116 2023.10.17
- International Announcement: WO2024/129238 EN 2024.06.20
- Date entered country: 2024-11-27
- Main IPC: H10D80/30
- IPC: H10D80/30 ; H01L23/04 ; H01L23/42 ; H01L23/32 ; H01L23/498 ; H01L23/367 ; H10B80/00

Abstract:
一种半导体器件封装件包括第一衬底和电连接到该第一衬底的接收端口。第一半导体裸片电连接到该第一衬底并且直接安装在该第一衬底上。第二衬底经由对应的接收端口电连接到该第一衬底并且被取向成大致垂直于该第一衬底。第二半导体裸片电连接到该第二衬底并且直接安装在该第二衬底上。壳体基本上包封上述部件中的每一者。该接收端口允许承载半导体存储器裸片的附加衬底连接到该第一衬底,从而增加该半导体器件封装件的总存储容量,同时符合预定义的形状因数。
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