发明授权
CN101410968B 具有应力沟道区域的改善的CMOS器件及其制造方法
失效 - 权利终止
- 专利标题: 具有应力沟道区域的改善的CMOS器件及其制造方法
- 专利标题(英): Improved CMOS devices with stressed channel regions, and methods for fabricating the same
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申请号: CN200780010670.X申请日: 2007-05-22
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公开(公告)号: CN101410968B公开(公告)日: 2011-08-17
- 发明人: 陈向东 , T·迪勒 , K·塞特尔迈尔 , 杨海宁
- 申请人: 国际商业机器公司
- 申请人地址: 美国纽约
- 专利权人: 国际商业机器公司
- 当前专利权人: 国际商业机器公司
- 当前专利权人地址: 美国纽约
- 代理机构: 北京市中咨律师事务所
- 代理商 于静; 李峥
- 优先权: 11/427,495 2006.06.29 US
- 国际申请: PCT/EP2007/054932 2007.05.22
- 国际公布: WO2008/000556 EN 2008.01.03
- 进入国家日期: 2008-09-24
- 主分类号: H01L21/8238
- IPC分类号: H01L21/8238 ; H01L21/336 ; H01L29/78 ; H01L29/04 ; H01L29/10 ; H01L29/165
摘要:
本发明涉及具有应力沟道区域的改善的互补金属氧化物半导体(CMOS)器件。具体而言,每个改善的CMOS器件包括具有位于半导体器件结构中的沟道区域的场效应晶体管(FET),所述半导体器件结构具有顶表面和一个或多个附加的表面,所述顶表面沿第一组的等价的晶体平面中的一个取向,以及所述一个或多个附加的表面沿不同的第二组的等价的晶体平面取向。可以通过晶体蚀刻容易地形成这样的附加的表面。此外,具有固有拉伸或压缩应力的一个或多个应力源层位于所述半导体器件结构的所述附加的表面之上并被设置和构建为向所述FET的所述沟道区域施加拉伸或压缩应力。可以通过假晶生长具有与所述半导体器件结构不同的晶格常数的半导体材料来形成这样的应力源层。
公开/授权文献
- CN101410968A 具有应力沟道区域的改善的CMOS器件及其制造方法 公开/授权日:2009-04-15
IPC分类: