集成电路、半导体装置及操作半导体装置的方法

    公开(公告)号:CN119207529A

    公开(公告)日:2024-12-27

    申请号:CN202410122789.1

    申请日:2024-01-29

    Abstract: 一种集成电路、半导体装置及操作半导体装置的方法。集成电路包括连接至位元线及互补位元线的感测放大器;用以储存数据信号并回应于字元线信号在位元线及互补位元线中的至少一者上选择性地输出数据信号的第一记忆体单元;连接于用以接收第一外部电压的第一电压端子与位元线之间并具有用以接收第一启用信号的第一启用端子的第一电路,其中第一外部电压不同于数据信号;以及连接于用以接收第二外部电压的第二电压端子与互补位元线之间并具有用以接收第二启用信号的第二启用端子的第二电路,其中第二外部电压不同于数据信号及第一外部电压。

    存储器设备及其操作方法
    2.
    发明公开

    公开(公告)号:CN119068940A

    公开(公告)日:2024-12-03

    申请号:CN202410683819.6

    申请日:2024-05-30

    Abstract: 示例存储器设备包含存储单元阵列、行锤管理电路及读取‑修改‑写入(RMW)驱动器。存储单元阵列包括多个存储单元行,并且存储用于对每个存储单元行的访问次数的计数数据。行锤管理电路执行RMW操作,所述RMW操作读出对应于存储单元行当中的目标存储单元行的计数数据,更新读出的计数数据,且将更新的计数数据写入存储单元阵列中。RMW驱动器基于预充电命令生成控制信号以控制RMW操作。在从施加预充电命令的时间点起经过预定时间之后,对目标存储单元行进行预充电。

    使用收获数据的快速、节能CMOS 2P1R1W寄存器堆阵列

    公开(公告)号:CN118800294A

    公开(公告)日:2024-10-18

    申请号:CN202310396303.9

    申请日:2023-04-13

    Abstract: 本申请涉及一种使用收获数据的快速、节能CMOS 2P1R1W寄存器堆阵列。提出了新的CMOS收获电路,其提高了2端口/多端口寄存器堆阵列电路速度,并且在将收获数据接合到自限制能量耗散时,实质降低了沿局部和全局位路径移动数据的能量代价。当收获数据的电势与来自信号发展的BL电压匹配时,通过所选单元中的自禁用动作消除由于单元读取电流的统计变化而引起的BL信号发展中的不确定性,同时与常规感测方案相比,每列需要更少的外围电路晶体管。提出的位路径电路接合收获电荷以在沿着WL的同时读取和写入访问期间提供对干扰电流噪声的免疫‑从而消除常规寄存器堆阵列中通常所需的BL保持器电路的性能、面积和能量开销。

    具有经延长数字线的设备和其操作方法

    公开(公告)号:CN113314172B

    公开(公告)日:2024-09-27

    申请号:CN202011499920.4

    申请日:2020-12-18

    Inventor: 何源 朴尚坚

    Abstract: 本申请案涉及具有经延长数字线的设备和其操作方法。描述与存储器装置相关的方法、设备和系统。所述存储器装置可包含具有被配置成为经连接经延长数字线预充电的感测电路的感测放大器。平衡电路可与所述感测电路相对地连接到所述经延长数字线。所述平衡电路可被配置成选择性地将所述经延长数字线连接到预充电源以为所述经延长数字线预充电。

    一种随机存储器
    5.
    发明公开

    公开(公告)号:CN118430609A

    公开(公告)日:2024-08-02

    申请号:CN202310088537.7

    申请日:2023-02-02

    Inventor: 邓鹏 杨一哲

    Abstract: 本申请公开了一种随机存储器,该随机存储器包括多个列选通模块,其中,每个列选通模块基于对应的列选通信号而决定当前互补位线对是否与连接的互补输入输出线对选通;列选通信号包括第一列选通信号和第二列选通信号,第一列选通信号为控制对应的列选通模块导通的列选通信号,第二列选通信号为控制对应的列选通模块截止的列选通信号;当随机存储器执行的当前写操作对应的写入数据为非屏蔽数据时,执行当前写操作对应的列选通模块接收的列选通信号为第一列选通信号,当随机存储器执行的当前写操作对应的写入数据为屏蔽数据时,执行当前写操作对应的列选通模块接收的列选通信号为第二列选通信号。通过上述方式,可以降低随机存储器的功耗。

    用于存储器装置中的数据管理的设备和方法

    公开(公告)号:CN113707199B

    公开(公告)日:2024-07-23

    申请号:CN202110539207.6

    申请日:2021-05-18

    Inventor: 何源

    Abstract: 本公开涉及用于存储器装置中的数据管理的设备和方法。在一些实例中,系统可包含多个存储器块、耦合到存储器装置中的所述多个存储器块的第一数据总线、耦合到所述多个存储器块的第二数据总线、经配置以经由所述第一数据总线对所述多个存储器块执行存储器读取和写入操作的控制器,以及经配置以经由所述第二数据总线将所述多个存储器块的第一存储器块中的数据传输到非易失性存储NVS装置的NVS数据传输电路。所述第一存储器块可以是在所述多个存储器块中最少存取的冷数据块。当经由所述第一数据总线同时存取不同的存储器块时,可经由所述第二数据总线执行所述冷数据传输。所述第二数据总线可以是所述存储器装置中的熔丝总线。

    用于存储器内操作的设备及方法

    公开(公告)号:CN112802517B

    公开(公告)日:2024-06-25

    申请号:CN202110184992.8

    申请日:2018-03-16

    Abstract: 本发明包含用于存储器内操作的设备及方法。一种实例设备包含存储器装置,所述存储器装置包含存储器单元的多个子阵列,其中所述多个子阵列包含所述相应多个子阵列的第一子集及所述相应多个子阵列的第二子集。所述存储器装置包含耦合到所述第一子集的第一感测电路,所述第一感测电路包含感测放大器及经配置以执行存储器内操作的运算组件。所述存储器装置包含耦合到所述第二子集的第二感测电路,所述第二感测电路包含感测放大器。所述存储器装置也包含控制器,所述控制器经配置以基于包含所述运算组件的所述第一感测电路引导数据值到所述第一子集中的选定子阵列的第一移动。

    半导体存储器
    8.
    发明授权

    公开(公告)号:CN117542389B

    公开(公告)日:2024-05-03

    申请号:CN202410034319.X

    申请日:2024-01-10

    Inventor: 尚为兵 高毅成

    Abstract: 本申请提供一种半导体存储器,包括:第一放大模块、第一控制管、第二控制管以及第二放大模块;第一放大模块的至少部分电路结构与第二放大模块的至少部分电路结构相同,第一放大模块与位线和互补位线连接,用于放大位线和互补位线之间的电压差,第二放大模块与本地数据线和互补本地数据线连接,用于放大本地数据线和互补本地数据线之间的电压差,本地数据线通过第一控制管与位线连接,互补本地数据线通过第二控制管与互补位线连接,第一控制管的控制端和第二控制管的控制端接收列选择信号。使得第一放大模块的版图结构和第二放大模块的版图结构相似,可以采用统一的制备工艺进行器件制备,降低工艺难度。

    具有行锤击地址锁存机构的设备

    公开(公告)号:CN112997251B

    公开(公告)日:2024-03-29

    申请号:CN201980073934.9

    申请日:2019-08-05

    Inventor: 大熊祯幸

    Abstract: 一种设备包含:地址总线,其经配置以传达命令地址;主要地址锁存器,其连接到所述地址总线且经配置以锁存第一地址;主要计数器,其连接到所述主要地址锁存器且经配置以在所述命令地址与所述第一地址匹配时跟踪主要计数值;及辅助计数器,其连接到所述主要计数器且经配置以在所述主要计数值达到主要阈值时更新辅助计数值。

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