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公开(公告)号：CN118426854A
公开(公告)日：2024-08-02
申请号：CN202310089086.9
申请日：2023-01-31
申请人： 芯华章科技股份有限公司
摘要： 本申请提供一种使用云计算运行应用程序的方法，所述方法包括：接收来自用户的运行第一应用程序的第一请求；解析所述第一请求以确定所述第一应用程序的个性部分和共享部分，其中，所述共享部分存储在共享存储中；在工作容器中运行所述个性部分；关联所述共享部分到所述工作容器；以及调用所述工作容器和所述共享部分运行所述第一应用程序。采用本方法能够提高应用程序的启动速度。
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公开(公告)号：CN118331566A
公开(公告)日：2024-07-12
申请号：CN202410594332.0
申请日：2021-11-05
申请人： 芯华章科技股份有限公司
摘要： 本公开提供一种显示逻辑系统设计的目标模块的方法及相关设备。其中，所述目标模块包括第一数量的多个子模块，所述第一数量的多个子模块包括第一子模块，所述方法包括：接收显示所述目标模块的第一指令；以及根据所述第一指令，在所述GUI界面中显示所述第一子模块的第一图标、指示其他子模块的第一集合图标以及与所述第一集合图标对应的第一展开符号。
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公开(公告)号：CN114237578B
公开(公告)日：2024-06-07
申请号：CN202111307384.8
申请日：2021-11-05
申请人： 芯华章科技股份有限公司
摘要： 本公开提供一种显示逻辑系统设计的目标模块的方法及相关设备。其中，所述目标模块包括第一数量的多个子模块，所述第一数量的多个子模块包括第一子模块，所述方法包括：接收显示所述目标模块的第一指令；以及根据所述第一指令，在所述GUI界面中显示所述第一子模块的第一图标、指示其他子模块的第一集合图标以及与所述第一集合图标对应的第一展开符号。
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公开(公告)号：CN113822004B
公开(公告)日：2024-01-05
申请号：CN202111101219.7
申请日：2021-09-18
申请人： 芯华章科技股份有限公司
发明人： 傅勇
IPC分类号： G06F30/34 , G06F30/343
摘要： 本发明涉及一种用于集成电路模拟加速和仿真的验证方法及系统，其中方法包括以下步骤：接收原电路设计，为原电路设计中原始存储逻辑生成一对应的老值存储逻辑，对应的原始存储逻辑完成计算后，将计算值赋予对应的老值存储逻辑，并将原始存储逻辑的后一逻辑计算步骤中的原始存储逻辑替换为老值存储逻辑。通过以上替换逻辑的方法，遍历原电路设计，生成变换后的电路设计；将所述变换后的电路设计分割为多个运算任务，并将所述各运算任务分配至多个处理器中执行，且各所述处理器之间设置有用于进行数据交互的连接通道；其中，所述运算任务中包含所述变换后的电路设计中的一个或多个设计单元，各所述运算任务中的运算进行了负载平衡。
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公开(公告)号：CN113283202B
公开(公告)日：2024-01-02
申请号：CN202110490570.3
申请日：2021-05-06
申请人： 芯华章科技股份有限公司
发明人： 张玉田
IPC分类号： G06F30/34 , G06F115/12
摘要： 本公开提供一种原型验证板。该原型验证板包括：处理器、可编程逻辑器件与控制器，其中，所述控制器与所述处理器和所述可编程逻辑器件连接，用于从所述处理器获取仿真配置文件并转发给所述可编程逻辑器件；并且所述处理器与主机通信地连接，用于从所述主机接收验证数据并根据所述验证数据确定配置数据。
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公开(公告)号：CN113946332B
公开(公告)日：2023-04-25
申请号：CN202110970101.1
申请日：2021-08-23
申请人： 芯华章科技股份有限公司
IPC分类号： G06F8/38
摘要： 本公开提供一种基于GUI界面显示属性的方法。所述方法包括：运行用于处理对象的指令；响应于所述指令的运行，获得所述对象的标识符；根据所述标识符确定所述对象是否满足给定条件；响应于所述对象满足所述给定条件，获取所述对象的属性以及所述属性的值；以及根据所述对象的属性以及所述属性的值生成所述GUI界面，其中，所述对象的所述属性的值在所述GUI界面中可编辑。本公开实施例通过充分利用现有指令的标识符，进而获取待显示的多组属性以及属性的值，同时开发GUI界面对这些属性以及属性的值提供显示或修改操作，方便了使用，进而提高了开发效率。
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公开(公告)号：CN112988570B
公开(公告)日：2023-03-10
申请号：CN202110172531.9
申请日：2021-02-08
申请人： 芯华章科技股份有限公司
发明人： 请求不公布姓名
IPC分类号： G06F11/36
摘要： 本公开提供了一种调试程序的方法、电子设备及存储介质。该方法包括：获取所述程序的可执行文件中的全局偏移表以及与所述程序相关联的多个动态函数；在所述全局偏移表中确定所述多个动态函数中的第一动态函数的第一地址；获取用于替换所述第一动态函数的第二动态函数的第二地址；更新所述全局偏移表以将所述全局偏移表中的所述第一地址替换为所述第二地址；以及基于所述更新的全局偏移表执行所述可执行文件。
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公开(公告)号：CN114327861B
公开(公告)日：2022-12-02
申请号：CN202111374748.4
申请日：2021-11-17
申请人： 芯华章科技股份有限公司
IPC分类号： G06F9/50 , G06F30/3308
摘要： 本申请提供一种执行EDA任务的方法、计算装置、计算系统、以及非暂态计算机可读存储介质。该方法包括：根据所述EDA任务，将所述EDA任务重构为根据给定流程顺序执行的多个子任务，所述多个子任务包括第一子任务和第二子任务；确定与所述多个子任务对应的多个计算资源，所述多个计算资源包括与所述第一子任务对应的第一计算资源和与所述第二子任务对应的第二计算资源；以及根据所述给定流程依次调用所述多个计算资源以执行所述多个子任务。
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公开(公告)号：CN115392157A
公开(公告)日：2022-11-25
申请号：CN202210775444.7
申请日：2022-07-01
申请人： 芯华章科技股份有限公司
IPC分类号： G06F30/30
摘要： 本公开提供一种验证系统及在验证系统的多个FPGA之间同步时钟的方法，其中所述系统用于对芯片设计进行仿真和验证。该系统包括一个验证板，所述验证板包括：接口，用于接收第一用户指令和第二用户指令；多个FPGA；时钟源，用于产生根时钟信号和同步信号；资源配置单元，用于根据所述第一和第二用户指令分别将所述多个FPGA中的第一部分配置为第一组FPGA、第二部分配置为第二组FPGA；多个时钟同步单元，连接到所述时钟源和所述资源配置单元，并且包括连接到所述第一组和第二组FPGA的第一和第二时钟同步单元，所述第一和第二时钟同步单元用于分别根据所述第一和第二用户指令生成施加到所述第一组和第二组FPGA的第一和第二时钟信号。
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公开(公告)号：CN115292102A
公开(公告)日：2022-11-04
申请号：CN202210550152.3
申请日：2022-05-20
申请人： 芯华章科技股份有限公司
发明人： 张昊
IPC分类号： G06F11/22
摘要： 本申请涉及仿真测试技术领域，具体公开了一种仿真方法、电子设备、可读存储介质，所述方法包括：接收待测设计的描述和测试环境的描述，所述待测设计和所述测试环境包括多个信号；根据所述待测设计和所述测试环境，在所述多个信号中识别所述待测设计和所述测试环境中的关键信号；根据所述关键信号确定所述待测设计和所述测试环境中的空闲信号；对所述待测设计进行仿真，其中，跳过对所述空闲信号的仿真。本申请通过获取待测设计的描述和测试环境描述，并基于待测设计和测试环境的关键信号确定待测设计和测试环境中的空闲信号，使得对待测设计进行仿真时跳过对空闲信号的仿真，可以进一步提高仿真效率，改善覆盖率统计，缩减测试时间。
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