不可信环境密钥管理方法
    43.
    发明公开

    公开(公告)号:CN119696765A

    公开(公告)日:2025-03-25

    申请号:CN202411755074.6

    申请日:2024-12-03

    Abstract: 本发明公开了不可信环境密钥管理方法,涉及密钥管理技术领域,该方法包括:生成随机盐值;基于所述随机盐值,对明文特征库与程序源码进行加盐计算,确定密态特征库与含盐程序;建立可信通道,通过可信通道,将密态特征库与含盐程序发送至不可信终端环境并进行加载;获取输入的网络数据报文,基于密态特征库与含盐程序,对不可信终端环境内输入的所述网络数据报文进行管理。本发明解决了现有技术中不可信终端环境中存在的特征库数据易泄露、遭受攻击风险高、特征匹配性能低以及网络数据报文管理缺乏有效机制的技术问题,达到了在不可信终端环境下保障数据安全,提高特征匹配性能以及确保网络通信正常有序的技术效果。

    数据包解析处理方法、装置、电子设备及存储介质

    公开(公告)号:CN119182839A

    公开(公告)日:2024-12-24

    申请号:CN202411177872.5

    申请日:2024-08-26

    Abstract: 本发明提供一种数据包解析处理方法、装置、电子设备及存储介质,其中方法包括:确定目标协议数据包中未被对应的目标标准化网络协议正确识别的未识别字段以及未识别字段的字段数据;基于未识别字段的关联字段的目标通用数据解析策略和目标自定义数据解析策略,确定多个目标数据解析策略;每个目标数据解析策略用于对未识别字段和字段数据进行解析;对多个目标数据解析策略各自的解析结果进行结果判决,并基于判决结果确定目标协议数据包的解析处理结果。本发明支持对基于标准协议修改的非标准协议开展流量解析工作,对于经过人为修改的协议中传输的数据包可以识别其所含的标准协议字段和非标准协议字段,提高了解析数据包的成功率和准确率。

    一种隧道报文的处理方法和装置

    公开(公告)号:CN114760166B

    公开(公告)日:2023-05-26

    申请号:CN202011582889.0

    申请日:2020-12-28

    Abstract: 本申请公开了一种隧道报文的处理方法和装置,所述方法包括:当接收到待处理隧道报文时,解析出所述待处理隧道报文的隧道头特征和原始报头特征;汇总所述待处理隧道报文的隧道头特征和原始报头特征,得到所述待处理隧道报文的综合特征;判断所述综合特征是否命中已存储的报文处理策略表,所述报文处理策略表包括若干隧道报文综合特征及处理策略之间的映射关系;若命中,则基于所命中的报文处理策略中的处理策略对所述待处理隧道报文进行处理。本申请方案,以包含待处理隧道报文隧道信息和原始信息的综合特征,作为报文处理策略的匹配指标,提高了隧道报文处理的准确性。

    一种隧道报文的处理方法和装置

    公开(公告)号:CN114697408A

    公开(公告)日:2022-07-01

    申请号:CN202011581609.4

    申请日:2020-12-28

    Abstract: 本申请公开了一种隧道报文的处理方法和装置,所述方法包括:当接收到待处理隧道报文时,解析出其隧道头特征;将所述待处理隧道报文的隧道头特征,与已存储的报文处理策略表进行匹配;若命中,根据所命中的报文处理策略处理所述待处理隧道报文;若未命中,解析出所述待处理隧道报文的原始报头特征;将所述待处理隧道报文的原始报头特征,与所述报文处理策略表进行匹配;若命中,根据所命中的报文处理策略处理所述待处理隧道报文。本申请方案,对接收到的待处理隧道报文进行双重匹配,提高了隧道报文处理的准确性。

    规则查询方法、装置、计算机设备和存储介质

    公开(公告)号:CN112383479B

    公开(公告)日:2022-03-22

    申请号:CN202011104222.X

    申请日:2020-10-15

    Abstract: 本申请涉及一种规则查询方法、装置、计算机设备和存储介质。该方法包括:计算机设备通过获取请求报文的五元组信息中的互联网协议IP地址,从预设的多个五元组规则表中,确定与该IP地址对应的目标五元组规则表,根据五元组信息查询目标五元组规则表,确定与五元组信息对应的目标五元组规则。本方法中,五元组规则表中包括五元组信息和五元组规则的对应关系,计算机设备在根据请求报文的五元组信息中的IP确定与其对应的目标五元组规则表之后,根据目标五元组规则表进行目标五元组规则的查询,避免了遍历所有五元组规则表的情况,减少了五元组规则的查询次数,节省了五元组规则的查询资源,进一步地,降低了FPGA的输入输出单元的消耗情况。

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