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公开(公告)号：CN103067305A
公开(公告)日：2013-04-24
申请号：CN201210571773.6
申请日：2012-12-25
Applicant: 北京四方继保自动化股份有限公司
IPC: H04L12/865
Abstract: 一种用于智能变电站智能终端设备的以太网发送时延优化方法，所述智能变电站智能终端设备的以太网通信架构采用CPU加FPGA的形式，其中，CPU做数据处理，FPGA实现接口和数据管理。在本发明中CPU上层软件对待发送的以太网数据进行优先级评定，由CPU下层软件将以太网数据以及优先等级表发送至FPGA，FPGA根据优选等级，将数据包按照高优先级优先的原则，向MAC发送数据。本发明优化以太网发送时延质量，提升了重要数据包的发送实时性，降低了其发送时延。
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公开(公告)号：CN106849024B
公开(公告)日：2018-11-30
申请号：CN201710143040.5
申请日：2017-03-10
Applicant: 中国南方电网有限责任公司电网技术研究中心 , 南方电网科学研究院有限责任公司 , 北京四方继保自动化股份有限公司
IPC: H02H7/22
Abstract: 本发明涉及基于FPGA实现继电保护装置SV订阅功能的方法和装置。所述方法包括：将数字化继电保护装置的原始CID文件转换为.ini文件，从所述.ini文件中提取SV订阅相关字段信息；将所述SV订阅相关字段信息转换为对应的bin配置文件，所述bin配置文件能够被所述数字化继电保护装置的FPGA芯片识别；在所述数字化继电保护装置上电之后，下载所述bin配置文件到所述FPGA芯片；通过所述FPGA芯片的配置解析逻辑对所述bin配置文件进行解析，得到实现SV订阅功能所需的模型信息，使得所述FPGA芯片根据所述模型信息实现SV订阅功能。本发明方案能够节省FPGA片内资源，并且有利于简化实现SV订阅功能所需的模型信息的解析过程。
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公开(公告)号：CN106953779A
公开(公告)日：2017-07-14
申请号：CN201710130707.8
申请日：2017-03-06
Applicant: 南方电网科学研究院有限责任公司 , 北京四方继保自动化股份有限公司
IPC: H04L12/26 , H04L12/939 , H04L12/437
CPC classification number: H04L43/0852 , H04L12/437 , H04L43/16 , H04L49/552 , H04L49/555
Abstract: 本发明涉及一种冗余环网节点监测方法和系统，其包括：在报文进入冗余环网之前，在报文中增加表征转发次数的转发标记，其中，在报文从数据源节点输出时，该报文的转发次数为预设初始值，在报文在冗余环网中的节点的第一网口、第二网口之间被转发时，该报文的转发次数加1；在监测到所述冗余环网的当前节点接收到的报文的频度超过预设的频度阈值时，检测所述当前节点接收到的报文的转发次数，获得检测结果；在所述检测结果表明当前节点接收到的报文中超过预设比例的报文的转发次数均为所述预设初始值，确定当前节点的前一级节点为数据源节点且该数据源节点存在异常。采用本发明方案，可以识别冗余环网中的问题节点。
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公开(公告)号：CN106789434A
公开(公告)日：2017-05-31
申请号：CN201611243650.4
申请日：2016-12-29
Applicant: 国网浙江省电力公司绍兴供电公司 , 国家电网公司 , 国网浙江省电力公司 , 北京四方继保自动化股份有限公司
IPC: H04L12/26
CPC classification number: H04L43/0852
Abstract: 本发明公开一种采样数据包传输延时测量方法及系统，在IEC61850 9‑2标准的采样数据包中添加延时字段，延时字段包括：特殊标识、链路总延时、本环节延时、帧校验；延时字段不影响原数据包的内容（包括帧头、内容、校验）；计算报文从上一个节点出口到本节点出口的链路延时 + 驻留延时，作为本环节延时，并添加到链路总延时里面，最终得到数据接收时刻和原始量之间的绝对延时，实现数据对齐。
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公开(公告)号：CN106681949A
公开(公告)日：2017-05-17
申请号：CN201611245747.9
申请日：2016-12-29
Applicant: 北京四方继保自动化股份有限公司
IPC: G06F13/28
Abstract: 一种基于一致性加速接口的直接内存操作实现方法，由FPGA在内部实现接收外设，将接收到的数据以直接内存存取的方式写入内存，并将数据包的描述信息同时写入内存，以数据包描述信息队列写指针更新的方式通知ARM处理器，ARM处理器以中断或查询的方式识别此指针是否更新，计算读写指针差，获取待处理数据包数量信息，数据的处理过程是，首先读取数据包描述信息，再根据所描述的数据包属性决定是否处理对应的数据包。本发明极大提高了处理器的处理效率和灵活性，简化了系统复杂性，相应提高了传输可靠性。用于数据吞吐量大、处理实时性要求高的电力系统控制领域。
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Patent Agency Ranking
公开(公告)号：CN103067305B
公开(公告)日：2015-09-02
申请号：CN201210571773.6
申请日：2012-12-25
Applicant: 北京四方继保自动化股份有限公司
IPC: H04L12/865
Abstract: 一种用于智能变电站智能终端设备的以太网发送时延优化方法，所述智能变电站智能终端设备的以太网通信架构采用CPU加FPGA的形式，其中，CPU做数据处理，FPGA实现接口和数据管理。在本发明中CPU上层软件对待发送的以太网数据进行优先级评定，由CPU下层软件将以太网数据以及优先等级表发送至FPGA，FPGA根据优选等级，将数据包按照高优先级优先的原则，向MAC发送数据。本发明优化以太网发送时延质量，提升了重要数据包的发送实时性，降低了其发送时延。
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公开(公告)号：CN102680775A
公开(公告)日：2012-09-19
申请号：CN201210181592.2
申请日：2012-06-04
Applicant: 北京四方继保自动化股份有限公司
IPC: G01R19/175 , G01R31/02
Abstract: 本发明公开了一种引入非常规PT监测避雷器阻性电流的方法和监测装置，监测装置接入合并单元MU的SV采样报文，对SV采样报文解码，检测母线电压过零点时刻，依赖外部同步时钟，精确计算通道延时，准确还原母线电压正弦波形。监测装置实时采集安装在避雷器本体接地线上的泄漏电流传感器信息，结合母线电压过零点时刻，将避雷器泄漏电流分解为阻性电流和容性电流。根据阻性电流变化率以及阻性电流值在避雷器泄漏电流中的比值诊断避雷器本体运行状态。本发明有效解决智能变电站或数字化变电站里，母线电压为数字信号时，一些在线监测装置无法引入母线电压信号计算避雷器阻性电流的问题，能早发现避雷器早期老化、绝缘隐患等缺陷，市场应用前景广阔。
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公开(公告)号：CN106953779B
公开(公告)日：2019-01-15
申请号：CN201710130707.8
申请日：2017-03-06
Applicant: 南方电网科学研究院有限责任公司 , 北京四方继保自动化股份有限公司
IPC: H04L12/26 , H04L12/939 , H04L12/437
Abstract: 本发明涉及一种冗余环网节点监测方法和系统，其包括：在报文进入冗余环网之前，在报文中增加表征转发次数的转发标记，其中，在报文从数据源节点输出时，该报文的转发次数为预设初始值，在报文在冗余环网中的节点的第一网口、第二网口之间被转发时，该报文的转发次数加1；在监测到所述冗余环网的当前节点接收到的报文的频度超过预设的频度阈值时，检测所述当前节点接收到的报文的转发次数，获得检测结果；在所述检测结果表明当前节点接收到的报文中超过预设比例的报文的转发次数均为所述预设初始值，确定当前节点的前一级节点为数据源节点且该数据源节点存在异常。采用本发明方案，可以识别冗余环网中的问题节点。
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公开(公告)号：CN106961396A
公开(公告)日：2017-07-18
申请号：CN201710170130.3
申请日：2017-03-21
Applicant: 中国南方电网有限责任公司电网技术研究中心 , 南方电网科学研究院有限责任公司 , 北京四方继保自动化股份有限公司
IPC: H04L12/861
CPC classification number: H04L49/9005 , H04L49/9021 , H04L49/9068
Abstract: 本发明涉及基于FPGA片内缓存实现SV报文处理的方法和装置。所述方法包括：接收订阅的SV报文帧，SV报文帧的ASDU数据集对应若干模拟量通道；对所述模拟量通道进行选择，解析被选取模拟量通道传输的报文信息，缓存至FPGA的第一级数据缓冲区；对第一级数据缓冲区的采样值数据进行低通滤波处理，将低通滤波处理后的采样值数据缓存至FPGA的第二级数据缓冲区；从所述第二级数据缓冲区各模拟量通道的缓存点中提取采样值数据，进行插值同步处理，缓存至FPGA的第三级数据缓冲区；将所述第三级数据缓冲区的采样值数据发送至处理器。本发明能够在简化整体系统设计的同时大幅提高数字化变电站装置的SV数据接入能力。
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公开(公告)号：CN103037032A
公开(公告)日：2013-04-10
申请号：CN201210559297.6
申请日：2012-12-20
Applicant: 北京四方继保自动化股份有限公司
Abstract: 本发明提出了一种使用FPGA实现SV数据32位寻址访问的方法，应用于智能变电站中的设备处理数字化采样数据。包括以下步骤：FPGA接收基于IEEE802.3标准的SV数据裸包，分析以太网帧数据结构，根据SV数据的以太网帧特点，将网络字节序的SV数据利用ASN.1编码规则的特征进行数据重组，转化为纯32位寻址的处理器可以直接访问的数据，大大提高SV解码处理效率的。本发明解决了纯32位寻址的处理器，通过软件进行拆分和重新整合方法处理网络字节序的SV数据方法引起的效率大幅下降问题，能提升解码效率5-10倍。
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