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公开(公告)号：CN103916327B
公开(公告)日：2017-02-08
申请号：CN201410106285.7
申请日：2014-03-21
Applicant: 西安电子科技大学
IPC: H04L12/803 , H04L29/08
Abstract: 一种HP2P网络负载平衡的方法，其包括，HP2P网络群间负载平衡的方法，通过群分裂以及群在网络地址空间的移动来实现群之间的负载转移，并通过新节点加入负载较大的群诱导群发生分裂和合并从而使得负载较大的地址空间群数目较多，负载较小的地址空间群数目较少；HP2P网络群内负载平衡的方法，通过超级节点对群内负载有效的调度，使群内负载率较低的节点找到群内负载率较高的节点。
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公开(公告)号：CN105487873A
公开(公告)日：2016-04-13
申请号：CN201510884819.3
申请日：2015-12-04
Applicant: 西安电子科技大学
Abstract: 本发明公开了一种保证质量的快速软硬件划分方法，保留遗传算法的交叉运算和变异运算，并引入阴性选择算法的阴性选择过程和基于等位基因浓度来指导产生新个体的策略，采取一种新型的进化方法来加速进化的过程并保证个体的质量，从而克服传统遗传算法耗时长以及阴性选择算法结果随机性大、容易陷入局部最优的缺点。
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公开(公告)号：CN103886137A
公开(公告)日：2014-06-25
申请号：CN201410074915.7
申请日：2014-03-03
Applicant: 西安电子科技大学
IPC: G06F17/50
Abstract: 本发明公开了一种实现现场可编程门阵列快速布局布线的方法，将退火函数应用于现场可编程门阵列FPGA布局的温度更新；采用了重复退火过程，得到每一次退火过程所能找到的最好解current_best，然后进行下一次退火过程；采用了考虑负载平衡的初始化布线方法，假设P为处理器个数，则创建P个线程，并将芯片分为P个区域，将信号分区域地划分到每个线程的任务集；采用了多线程并行执行布线迭代，P个线程根据并行化的A*寻址算法并发地为各自任务集中每个信号寻找当前最合适的路径进行布线；采用重布线拥挤信号的方法，完成一次布线迭代。本发明实现了对布线过程的加速，使得最终电路的延时和线长两个重要性能指标基本不变的情况下，布局布线速度有了显著加快。
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公开(公告)号：CN103885796A
公开(公告)日：2014-06-25
申请号：CN201410074912.3
申请日：2014-03-03
Applicant: 西安电子科技大学
IPC: G06F9/445
Abstract: 一种基于脚本工具的软件动态部署方法，其包括：S1提供一服务器，所述服务器加入新软件时，服务器端启动脚本自动生成程序并运行所述软件，所述自动脚本生成程序监控并记录安装过程中鼠标点击的控件句柄，并生成安装所述软件时的鼠标点击的脚本文件，且所述服务器设有数据库，所述脚本文件存入所述数据库中，且所述数据库还存有所述软件的基本信息；S2提供至少一个客户端，所述客户端检测目标机器物理环境配置并生成硬件信息记录文档并发送至服务器；S3服务器端将接收客户端发送来的硬件信息记录文档，并写入数据库；S4服务器选择软件与客户端并将待部署软件发送至客户端；S5若部署成功，则软件动态部署过程结束，若部署失败，则启动补偿策略。
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公开(公告)号：CN119987947A
公开(公告)日：2025-05-13
申请号：CN202510117004.6
申请日：2025-01-24
Applicant: 西安电子科技大学
IPC: G06F9/455 , G06F8/61 , H04L41/0803
Abstract: 本发明涉及计算机技术领域，提供了一种云原生操作系统实验平台搭建方法、装置和存储介质，应用于服务器集群上，服务器集群包括多个服务器，服务器包含多个预设信创处理器、以及搭载预设信创处理器对应的操作系统，获取服务器的配置要求。根据配置要求以及预设配置要求，在服务器上部署Kubernetes应用，构建Kubernetes集群。针对Kubernetes集群，通过Kubernetes扩展工具，在Kubernetes集群上创建运行多个Qemu虚拟机。由于预设信创处理器、操作系统、Kubernetes应用以及Qemu虚拟机支持同一预设指令集。在进行实验时，无需对预设信创处理器、操作系统、Kubernetes应用以及Qemu虚拟机之间的指令进行翻译，以此降低了操作系统实验平台在进行实验过程中的性能损失。
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Patent Agency Ranking
公开(公告)号：CN105488285B
公开(公告)日：2020-05-22
申请号：CN201510883669.4
申请日：2015-12-04
Applicant: 西安电子科技大学
IPC: G06F30/343
Abstract: 本发明公开了一种高效FPGA技术映射算法，将技术映射划分为逻辑优化与结构优化，逻辑优化部分采用AIG模型以及balance、rewrite以及refactor等技术对电路进行优化；结构优化部分采用DAG模型，分为划分产生、划分选择以及LUT映射三步，划分产生采用了动态规划的思想，快速为每一个节点产生所有k‑可行划分；划分选择基于一种迭代次数可以自适应改变的迭代启发式思想，通过多次向前遍历与向后遍历的迭代，最终选择出延时和面积同时被优化的划分集合，与此同时，本发明修正了节点面积流计算公式，提高了划分选择的随机性；LUT映射将划分选择产生的划分结合映射成为LUT网络。
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公开(公告)号：CN106911785A
公开(公告)日：2017-06-30
申请号：CN201710121171.3
申请日：2017-03-02
Applicant: 西安电子科技大学
CPC classification number: H04L67/06 , H04L67/1061 , H04L67/28 , H04W28/021 , H04W40/04
Abstract: 本发明属于互联网计算技术领域，公开了一种移动点对点网络MHP2P的架构及相关服务实现方法。本发明基于一种稳定性和查询效率高、可扩展的HP2P网络，通过普通结点作为热点的形式使邻近的移动结点连接到普通结点，以使在原有网络拓扑结构不变的情况下可以较容易地融合移动结点。本发明每个普通结点看作附着在其上的移动结点的代理，通过代理来实现移动结点的资源发布、查询下载和元数据冗余等服务；其次还包括移动结点自身对局部单点失效的处理。本发明移动结点连接MHP2P网络的方式简单，易于实现；基于父结点的代理，实现了代码重用，解决了移动结点处理能力可能不足的问题；融合HP2P网络，保证了稳定性和高的查询效率。
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公开(公告)号：CN106371887A
公开(公告)日：2017-02-01
申请号：CN201610980621.X
申请日：2016-11-08
Applicant: 西安电子科技大学
IPC: G06F9/45
Abstract: 本发明公开了一种MSVL语言的编译系统及方法，包括：MSVL前端和底层虚拟机后端；MSVL前端包括词法语法分析模块，预处理模块和中间代码生成模块；LLVM后端包括目标代码生成模块；所述MSVL语言的编译方法对MSVL中的简单语句用正则形的方法进行预处理，对复杂语句，分别对每个并发分量进行预处理，并对每个并发分量创建一个线程。本发明很好地解决了现有技术执行MSVL程序效率低，影响了程序验证和执行的效率的问题，提高了MSVL程序的执行和验证效率；根据程序本身复杂程度的不同，其执行速度可提高几十倍乃至上百倍；并且一次编译成功后程序可以反复执行，无需再次编译。
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公开(公告)号：CN103914587A
公开(公告)日：2014-07-09
申请号：CN201410074911.9
申请日：2014-03-03
Applicant: 西安电子科技大学
IPC: G06F17/50
Abstract: 本发明公开了一种基于模拟退火/回火现场可编程门阵列布局的方法，采取混合模拟退火和模拟回火的方法。首先使用传统模拟退火方法，得到模拟退火所能找到的最好解current_best，并记录当解的接受率为44%时的温度temp44，建立从temp44到冰点温度的适宜的温度梯度{t1,t2,…,tm}，然后根据该温度梯度开始模拟回火方法，在这个过程中如果碰到了比current_best更好的解，用该解替换current_best，最终得到的current_best即为需要的最优解。将本发明公开的基于模拟退火/回火现场可编程门阵列布局的方法应用于支持FPGA（Field？Programmable？Gate？Array）现场可编程门阵列开发的EDA软件的布局工具，最终得到的布局结果稳定性好，同时能提高电路的质量，降低关键路径上的延时，改善最终的布线线长。
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公开(公告)号：CN103745057A
公开(公告)日：2014-04-23
申请号：CN201410008483.X
申请日：2014-01-08
Applicant: 西安电子科技大学
IPC: G06F17/50
Abstract: 本发明公开了一种FPGA中进行电子设计自动化的逻辑单元装箱方法，主要解决现有技术装箱后电路时延过大，可配置逻辑单元CLB消耗过多的问题。其装箱过程是：将工艺映射，单元划分处理后的电路用有向无环图表示；通过电路中查询表LUT之间的连接方式对有向无环图中的时延信息进行初始化；通过广度优先遍历法计算每个节点的松散度，并结合每个节点对电路关键路径的影响计算出它的关键度；根据每个节点的关键度并结合查询表LUT的线网个数和可配置逻辑单元CLB中已使用的线网个数，计算每个查询表LUT的线网增益值，根据线网增益值对查询表LUT进行选择填装。本发明极大地降低了最终电路的时延，同时极大地减少了最终电路消耗的可配置逻辑单元CLB的数量。
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